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[参考译文] LMK05318BEVM：无本地参考时出现锁定检测问题

admin
Guru**** 2383950 points
Other Parts Discussed in Thread: LMK05318B
请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/clock-timing-group/clock-and-timing/f/clock-timing-forum/1135358/lmk05318bevm-lock-detection-issue-when-no-local-reference

器件型号：LMK05318BEVM
主题中讨论的其他器件：LMK05318B

大家好、

 遇到此问题时、我刚刚完成了 LMK05318B 的评估：

我使用 STATUS0和 STATUS1作为 All2和 DPLL 的锁定检测指示器(我使用 具有级联 APLL2的 DPLL 模式)

STATUS0设置为- DPLL 锁相检测

STATUS1设置为 - PLL2数字锁定 检测

步骤1：D4和 D5 LED 均亮起(表示两个 PLL 均已锁定)

步骤2：我已移除跳线 J9 (本地 XO VCC)以模拟故障、实际上两个 LED 都已关闭。

步骤3：重新插入 J9使我返回到第1步、正如预期的那样。

步骤4：按照预期、移除外部基准、D4 (DPLL 指示灯)关闭、然后在重新连接外部基准时重新打开。

到目前为止、每个指示灯都正常工作、直到我在 EVM 电源关闭然后打开时重复所有步骤：

步骤5：EVM 关闭、J9被移除、外部基准打开。  

第6步：EVM 打开、D5 (APLL2 指示器)打开、此时 不应打开、因为没有48.0048MHz 基准。

步骤7： 重新插入 J9和 D5保持开启状态

步骤8： 卸下 关闭的 J9和 D5 (恢复正常运行)

简而言之、在没有本地基准的情况下为芯片上电时、ALPP2数字锁定检测存在错误指示。

我发现了这篇文章、描述了几乎相同的问题、但对于不同的 PLL：

https://e2e.ti.com/support/clock-timing-group/clock-and-timing/f/clock-timing-forum/1116391/lmx2595-lock-detect-reports-sporadic-false-lock-when-refin-removed/4143089#4143089

是否有办法解决此问题？ (我的设计中未使用任何系统主机)

谢谢、

NIR

  • 0
    TI__Guru**** 2383950 points
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    NIR、您好！

    EVM EEPROM 是否已编程到您的寄存器设置？ 我想知道、在步骤6中、您是否运行出厂时配置的默认 EEPROM 设置(请参阅数据表)。 在这种情况下、路由到 D5的状态1显示 DPLL 保持活动模式。

    此致、

    Jennifer

  • 0
    TI__Guru**** 2383950 points
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     您好、Jennifer、

    EEPROM 实际上编程为以下配置：

    STATUS0 - DPLL 锁相检测

    STATUS1 - PLL2数字锁定 检测

    谢谢、

    NIR

  • 0
    TI__Guru**** 2383950 points
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    NIR、您好！

    您能否共享您用于对 EEPROM 进行编程的.TCS 配置？

    此致、

    Jennifer

  • 0
    TI__Guru**** 2383950 points
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    您好、Jennifer、

    很抱歉耽误你的时间、这是 file.e2e.ti.com/.../10M_5F00_REF_5F00_32M_5F00_OUT7_5F00_SE_5F00_CMOS.tcs

    谢谢、

    NIR

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    TI__Guru**** 2383950 points
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    您好、Jennifer、

    新消息？ 是否运行了脚本？

    谢谢

    NIR

  • 0
    TI__Guru**** 2383950 points
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    NIR、您好！

    很抱歉让我们等了一会。 是的、我运行了脚本并按照 您的步骤操作-我看到的问题相同。  

    目前、请向我们的设计团队核实这种情况的原因。 当我们有更新时、我会告诉您。

    此致、

    Jennifer

  • 0
    TI__Guru**** 2383950 points
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    您好、Jennifer、

    感谢您的确认、正在等待进一步更新。

    此致、

    NIR  

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    TI__Guru**** 2383950 points
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    您好、Jennifer、

    您能否与设计团队核实我的问题？

    谢谢

    NIR

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    TI__Guru**** 2383950 points
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    NIR、

    在讨论设计之后、我进行了以下更新：

    • PLLn DLD 状态基于 PLLn 调谐电压(Vtune)。 当在 POR 时 XO 输入缺失时、PLLn DLD 可能读为高电平、因为 Vtune 由于浮动信号或电荷泵电流泄漏而下降到所需的调优阈值内。 这不是评估 APLL 锁定的推荐方法。 该状态信号旨在用作调试位。
    • 如果您尝试确定 DPLL 锁定、建议改用 LOPL_DPLL 或 LOFL_DPLL 信号。

    此致、

    Jennifer

  • 0
    TI__Guru**** 2383950 points
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    您好、Jennifer、

    我的意图是表明：

    1-仅使用本地基准时 APLL 锁定

    2-当10MHz 基准有效/有效时 DPLL 锁定。

    对于 DPLL 锁定、我确实使用 LOPL_DPLL、它运行正常

    如果 APLL DLD 不 是评估 APLL 锁定的推荐方法、那么正确的选择是什么？

    谢谢、

    NIR

  • 0
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    NIR、

    我理解您的提问。 若要在仅使用本地基准时检测 XO 的 APLL 锁定、请启用 BAW 锁定检测并读回 R80[7]。 请注意 、该位不能路由到 STATUSx 引脚。

    此致、

    Jennifer

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    TI__Guru**** 2383950 points
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    您好、Jennifer、

    我的设计是一个独立模块(无 MCU)、因此无法读取上述寄存器。

    还有其他选择吗？

    谢谢

    NIR  

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    TI__Guru**** 2383950 points
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    NIR、您好！

    除了 BAW_LOCK 之外、没有其他状态位可检查 APLL 锁定。

    我需要更好地了解您的应用。

    1. 在 DPLL 基准消失的情况下、您是否希望检查 APLL 何时锁定？
    2. 换句话说、您有一个板(使用 APLL 和 DPLL)还是两个单独的板(一个仅使用 APLL、另一个使用 DPLL + APLL)？
    3. 想要 APLL 锁定检测位的原因是什么？

    此致、

    Jennifer

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    TI__Guru**** 2383950 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

    您好、Jennifer、

    问题1. 是-当不需要高频精度、或者外部基准发生故障或被移除时、模块可以指示 APLL 锁定。

    问题2. 一个板同时具有 APLL 和 DPLL 指示灯

    问题3. 如 Q1中所述。

    此致、

    NIR

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    TI__Guru**** 2383950 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

    NIR、您好！

    您可以使用 DPLL 保持活动位来指示 DPLL 基准何时丢失以及器件何时转变为保持模式(仅 APLL 模式)。 同样、这不会指示 APLL 是否已锁定。 如果存在有效的 XO 输入电平和频率、APLL 将锁定到 XO。 您可以使用 LOS_XO 位确认存在 XO 输入。


    此致、

    Jennifer