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[参考译文] LMK04610：LMK04610设计验证

admin
Guru**** 2502465 points
Other Parts Discussed in Thread: LMK04610

请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/clock-timing-group/clock-and-timing/f/clock-timing-forum/739579/lmk04610-lmk04610-design-verification

器件型号：LMK04610

您好！

我们正在设计具有 PLL1旁路的单 PLL 模式下的 LMK04610。 LMK 的输入是 CLKin0端口的100MHz 差分 LVDS 输入。 要求是生成3个90MHz 的输入和4个9MHz 的输出(Sysref 信号)。  PFD 频率为10MHz、VCO 频率配置为5850MHz。 N 分频器值应为117。

对于上述设置，该工具计算出的 PLL2环路带宽大于10MHz。 请阐明这是工具问题还是配置问题。

此致、

Ayesha

 

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    TI__Guru**** 2502465 points
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    请查找随附的 referencee2e.ti.com/.../90MHz_5F00_tics2.7z TICSpro 文件

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    TI__Guru**** 2502465 points
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    您好、Ayesha、

    感谢您附加配置文件！  出于好奇、E2E 是否阻止您附加.TCS 文件？  我以前见过这种反馈、但我能够附加.TCS 文件... 如果确实如此、我将向 E2E 团队提供一些反馈、以便为任何用户提供.TCS 文件附件。

    我假设您的基准是干净的、因此您使用的是单环路而不是双环路。

    我能够使用50MHz 相位检测器频率来改进设置。  因此我更新了 PLL2_RDIV = 2。  为了在50MHz PDF 频率下实现5850MHz 的 VCO 频率、我设置 PLL2_PRIER_TOP = DIV3且 PLL2_NDIV = 39。

    然后、当我将器件配置加载到 PLL2环路滤波器计算器中并设计了一个200kHz 环路带宽滤波器时、似乎没有问题。  然后、我将这些设置应用回配置、请查找附件以供您参考。

    73、
    Timothy

    e2e.ti.com/.../90MHz_5F00_tics2_2C00_-TT.tcs

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    TI__Guru**** 2502465 points
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    您好、Timothy、

    是的、我们使用的是干净的源、因此绕过了 PLL1。 是的、我无法附加.TCS 文件、因此已将其转换。  

    我需要生成90MHz 和9MHz 时钟。 它是 PLL2_prescaler_top 输出、该输出将被分频为90MHz。 因此、将其设置为3将为1950 MHz、该频率不能分频为90 MHz。 因此、我需要将预分频器设置为5以获得1170MHz 的频率、并将 PFD 设置为10MHz。

    但是、仅在高 N 分频器值(或低 PFD 频率)下才会观察到环路带宽问题。 请告诉我原因。

    此致、

    Ayesha  

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    TI__Guru**** 2502465 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

    您好、Ayesha、

    很抱歉、我的错误、请找到所附的更正文件。  通过使用5940MHz 的 VCO 频率和3的预分频器、您可以使用22和220的输出分频器获得90MHz 和9MHz 的输出。  PLL2 N 分频器为99。  由于相位检测器的频率可以是20MHz 而不是10MHz、因此该设置会更好一些。

    我将需要进一步研究、看看我是否可以找到计算出的环路带宽返回错误的原因。  似乎在适当的值前面有一个10。  上述文件中的20MHz PDF 会发生这种情况、此错误不会出现。

    73、
    Timothy

    e2e.ti.com/.../90MHz_5F00_tics3_2C00_-TT.tcs