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[参考译文] CDCE913-Q1：输出电压电平

admin
Guru**** 2392385 points


请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/clock-timing-group/clock-and-timing/f/clock-timing-forum/668900/cdce913-q1-output-voltage-level

器件型号：CDCE913-Q1

您好！

我希望您在以下情况下确认输出电压电平。

条件：

输入时钟选择：VCXO

2.使用的输出：Y1

问

*当我们设置"Y1 ENABLE"且没有输入到"XIN/CLK 引脚"时、 会在"Y1"引脚上观察到哪个电压电平？

此致、

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    TI__Guru**** 2392385 points
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    尊敬的 Machida：

    感谢您的提问。 我将在星期一回答您的问题。

    此致、Simon。
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    TI__Guru**** 2392385 points
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    您好、Machida、
    在 LVCMOS 输入模式下、如果 CLKIN 引脚上没有输入(可以是高电平或低电平)、则不能保证输出。
    在 VCXO 模式下、输出应该为低电平、但在 VCXO 模式下、启用极高增益放大器(在 XIN 引脚上)、放大器将自动移至最高增益设置、因此任何噪声都可能被放大。 我建议避免这种情况。
    如果您使用 VCXO 模式、那么为什么会出现问题、因为您将在板上连接 XTAL！
    此致
    Puneet