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[参考译文] CDCUN1208LP:电源定序问题

Guru**** 2509075 points
Other Parts Discussed in Thread: CDCUN1208LP

请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/clock-timing-group/clock-and-timing/f/clock-timing-forum/690127/cdcun1208lp-power-sequencing-issue

器件型号:CDCUN1208LP

我在尝试加电时遇到 CDCUN1208LP 问题。 配置如下:

  • 3.3V 为内核(引脚5)和 VDDO4 (引脚27)供电
  • 1.8V 为 VDDO1 (引脚11)和 VDDO2 (引脚14)供电
  • VDDO3 (引脚22)悬空、100nF 电容连接到 GND

按照以下顺序、CDCUN1208LP 启动并似乎正常工作-在实际开启之前、请注意3.3V 中的电压升高。

CDCUN1208LP is working

我清除了这个凸点(电路板没有其他更改)、并且使用以下(更好的外观)序列、CDCUN1208LP 不再开始!

CDCUN1208 is not working here.

我认为我尊重芯片的所有上电要求、即在 VDDOx 电压(3.3V 和1.8V)之前或同时、上升时间和内核(3.3V)大于6.5V/ms

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。
    尊敬的 Chris:

    我已将您的问题分配给工程师。

    感谢您的耐心等待。

    此致、Simon。
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    非常感谢。

    此外、在同一电路板上还有2个 CDCUN1208LP 可看到相同的3.3V 内核电压(和斜升)、这可能会有所帮助、但是、这些缓冲器的 VDDOx 也连接到3.3V 内核电压、并且在所有情况下都正确启动。

    此致、Christoph

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    尊敬的 Christoph:
    我认为这与控制引脚和3.3V 内核电压有关。 该器件仅在触发内部 POR 电路后对某些控制引脚进行采样、以确定其运行模式。 对 OE 等引脚进行持续评估。
    我想、在之前的凸点情况下、内核电压的3.3V 与 VDDO 上的1.8V 之间有更多的延迟。
    让我检查 POR 触发器和控制引脚采样发生的详细信息。

    此致、
    Patrick
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    以下是该器件的原理图部分、可帮助您进行分析:

    Clock buffer circuit

    我怀疑输入选择没有正确采样、尽管我认为它(作为 OE 引脚)始终被采样。

    如前所述、我们使用配置非常相似的缓冲器(见下文)、并且在第一个线程中描述的2种情况下、这些缓冲器始终正确启动:

    Clock circuit #2

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    尊敬的 Christoph:
    我可以确认内部逻辑仅连接到 VDD 引脚5。 这意味着、只要您的3.3V 上电正常、这应该正常工作。 由于我现在无法解释原因、我开始在实验室中对某些电路板进行返工、以创建您的工作和非工作配置、从而重现问题。
    您能告诉我您尝试缓冲的频率吗?

    谢谢!

    此致、
    Patrick
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    您好!

    我们正在缓冲50MHz 时钟信号、正如您在图片中看到的、我们使用一个缓冲器(这是一个缓冲器、这会产生问题)将其分频为25MHz、并使用另一个缓冲器将3.3V 输出缓冲为50MHz (这不会产生问题)。
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    尊敬的 Christoph:
    我无法重复您目前看到的问题。 我为明天安排了一个可以调整压摆率的电源、因此我可以在类似的条件下对其进行测试。
    您是否尝试对设备执行"遵循故障切换"?

    此致、
    Patrick
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    尊敬的 Christoph:

    我在随机选择的 EVM 上尝试了您的配置。 您是否有机会更换设备?

    此致、

    Patrick

    e2e.ti.com/.../CDUN1208LP_5F00_e2e_5F00_supplyramps.pdf

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    您好!

    具有查看波形的网格解决方案在我们生产的4个不同的示例板上工作。 我还没有测试它们是否都出现故障、波形看起来更漂亮。 我可以尝试在不同的电路板上重复该测量。

    但是、您是否同意、原则上芯片应以第一张示波器图片中所示的波形正确启动?  

    此致、

    Christoph

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    您好 Christoph、

    请随时向我更新、当特定部件在进入以前的工作地点时仍然出现故障时、我想向故障分析实验室提供此信息。

    请考虑通过以下邮件列表或您的 TI 质量联系人与我联系!

    此致、

    Patrick

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    您好、Christoph、
    '为了使器件正常运行、在施加任何输出功率之前、必须施加内核电源电压(引脚5)
    或与输出电源的应用同时使用。 之前的输出电源应用
    应用内核电源可能会导致器件行为不当。"

    我认为将 VDDO 1.8V 延迟可以帮助您的混合电源应用。

    此致、
    肖恩
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    您好!

    因此、我能够使用其他器件进行测试、并尝试了稍微不同的配置来为 CDCUN1208LP 的电源轨进行门控。 M1和 M2连接到1k 电阻器 R1和 R5的配置工作、而如果我改为将 D1和 D2连接到这些电阻器、则缓冲器不会启动。 原则上、产生的斜坡看起来非常相似(压摆率略有不同、但都高于6500V/s)。

    Power Gating Circuit 

    这里是工作配置(M1和 M2将栅极拉至低电平)。

    CDCUN1208LP with M1 and M2 configuration

    这是不起作用的配置(D1和 D2将栅极拉至低电平)。

    CDCUN1208LP with D1 and D2 configuration

    在这两种情况下、C2迹线(品红色)都是3.3V VDDOx 提供的一个时钟输出。 由于振荡器的启动(也提供相同的3.3V 电压)、振荡在大约4ms 后开始。 时钟缓冲器输出端斜坡期间的杂散信号在这两种情况下都出现、我没有完全预料到这一点、但输出缓冲器最初处于 LVDS 模式、然后在正确读取 ITTP 引脚切换到 LVCMOS 模式后、是否可以完全预期?

    但是、我现在有一个具有干净斜坡的工作解决方案(M1和 M2)。 虽然最好准确地了解其他配置似乎不起作用的原因、但我实际上无法在我们的硬件上执行大量调试和电路修改。 我现在使用此配置测试了5块电路板、它们都在实验室条件下工作。