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[参考译文] LMX2592：LMX2592相位终止

admin
Guru**** 2578945 points
Other Parts Discussed in Thread: LMX2594, LMX2592

请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/clock-timing-group/clock-and-timing/f/clock-timing-forum/713490/lmx2592-lmx2592-phase-determinance

器件型号：LMX2592
Thread 中讨论的其他器件：LMX2594、

Dean、

我们的应用提供1200MHz 的输入基准时钟、需要2个600MHz 的输出时钟、最好锁定在基准的上升沿。  我们最初尝试了 LMX2594、但由于输入和输出时钟之间的小数关系(600/1200 = 1/2) 、我们被归入类别3。  因此、我们可以实现锁相并合成600MHz 输出、但无法对相位确定性操作进行软件同步调整、并且我们对同步线路的硬件控制不够精确、无法实现边缘锁定。  此外、类别3中不提供使用 MASK_SEED 技术的精细相位调整。  

接下来、我们尝试了 LMX2592、VCO 为4800、输出分频值为8、输入分频值为24。  我们能够合成600MHz 输出并利用 MASK_SEED 执行极其精细的相位调整。  但是、加电后输入和输出时钟之间的初始相位关系和寄存器配置是不确定的。  它似乎随机为初始锁定选择八个不同相位关系中的一个。  其中任何一个都可以、因为相位调整效果非常好。  对于我们的应用、我们似乎需要的是 LMX2592和 LMX2594的混合器件。  

鉴于我们的设计要求和 PLL 设置、我们是否可以采用任何机制、例如寄存器编程顺序、VCO 或 PFD 设置的组合等、以实现一致的初始相位关系？  如果是这样、我们可以根据需要应用 MASK_SEED 相位调整来调整输出时钟。

谢谢、

- Ken

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    TI__Guru**** 2578945 points
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    Ken、

    与 LMX2594相比、LMX2592的相位同步功能更强大。

    非常感谢您透彻地阅读数据表(必须是同步流程图)，因为 Fout%Fosc <>0，这表明这是类别3。

    但实际上、您在图表中发现了一个错误。 类别2表示同步计时脉冲不重要。 如果您考虑这一点、即使同步脉冲在一个 OSCin 周期关闭、Fosc 和 Fout 之间也将保持相同的相位关系。 因此，对于这种情况，更正确的说法是(Fout%Fosc>0)和(Fosc%Fout>0)。 我将更新数据表。

    此致
    Dean
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    TI__Guru**** 2578945 points
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    Ken

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    TI__Guru**** 2578945 points
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    Dean、
    感谢您的快速响应。

    我很困惑：
    您说类别2现在将被定义为：Fout%Fosc 和 Fosc%Fout 必须都大于零吗？ 还是这是一个拼写错误、Fout%Fosc 必须仍然等于零。 如果这不是一个拼写错误、那么只有 Fosc 的非整数倍数才符合类别2的条件。

    即、对于 Fout = 600MHz：Fosc = 100MHz = 6%1 = 0 ->类别3
    Fosc = 200MHz = 6%2 = 0 ->类别3
    Fosc = 300MHz = 6%3 =0 -->类别3
    Fosc = 400MHz = 6% 4 = 2 ->类别2
    Fosc = 500MHz = 6%5 = 1 ->类别2
    对吗？

    但是、如果 Fout%Fosc = 0仍然适用于类别2、那么我是使用外部输入计数器将我的1200MHz 基准除以4还是使用前置 R 分频器将1200MHz 输入除以4、有何区别？ 相位检测器如何知道差异？ 即使前置 R 分频器和后置 R 分频器共同提供24分频值、出现在相位检测器上的生成时钟上升沿是否会与 Fosc 的上升沿减去一些较小的传播延迟紧密对齐？ 如果是、为什么这还不能让我们成为第2类？

    很抱歉我的长条。 我只是想把我的大脑围绕这个部件的实际工作方式、如果我能够以某种方式使它满足要求苛刻的客户的要求。

    修订后的数据表发布之前多久会发布一次？

    再次感谢、

    - Ken
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    TI__Guru**** 2578945 points
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    Ken、

    以这种方式来考虑、当应用同步脉冲时、它会重新计时到闭合的 OSCin 周期。

    在类别2中、有必要同步器件、但不管它是什么 OSCin 周期。

    对于3类、什么 OSCin 周期很重要。

    忽略 OSCin 和 Fout 之间的所有电路； 这是使人们对2类感到困惑/分心的原因。  

    因此、如果 Fout%Fosc=0、这意味着如果我获取 Fout 的任何上升沿并与 Fosc 的闭合上升沿进行比较、我将获得相同的值。  因此、具有100MHz 输入的300MHz 输出可满足这一要求。   

    同样、如果 Fosc%Fout=0、这意味着如果我获取 Fout 的任何上升沿并与 Fosc 最近的上升沿进行比较、我将得到相同的值、因此输入为1200MHz 的300MHz 输出满足这一要求、也应该是类别2。

    现在、如果我有100MHz 输入和101MHz 输出、那么 Fout 和 Fosc 之间的相位关系取决于选择的 Fout 周期。  因此、为了在这里的两个器件之间实现相位对齐、同步发生在什么 Fosc 周期上至关重要。

    此致、
    Dean

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    TI__Guru**** 2578945 points
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    Dean、
    好消息是、我一直能够将600MHz 输出时钟锁定在1200MHz 输入时钟的上升沿。 这似乎确认了 Fosc%Fout =0是确定性相位锁定的有效条件(希望是类别2)。 但是、每次启用 VCO_PHASE_SYNC 时、在 TICSPro GUI 输出窗口中会提醒我：

    “设备处于同步类别3 (需要定时同步)：
    这是因为输出频率不是输入频率的倍数。
    另请查看数据表以了解最大输入频率的限制。”

    此外、由于类别3需要定时硬件同步输入、因此偶尔会提醒将 INPIN_IGNORE 设置为0。

    现在、我有了可靠的锁、我希望能够利用相位调整功能、在需要时为客户提供一些微调。 但是、数据表第26页上的公式(5)似乎并不像我最初以积分100MHz 振荡器作为输入运行 EVM 时那样适用。 使用1的 MUS_SEED 和24的 PLL_DEN、每次我写入 MUS_SEED 寄存器时、它都会向左移相、直到计数12、然后向右移相12、然后重复。 我看不到它超过180度。 我正在使用二阶 Δ-Σ 调制器、N_Divider = 16、当 VCO_PHASE_SYNC = 1时、IncludedDivide 为4。

    这是否是真正不在类别2中的函数、或 GUI 将控制寄存器覆盖为类别3模式？ 是否可能需要修改公式(5)以处理 Fosc%Fout = 0条件？ 或者可能只是驾驶舱错误。

    我可能只能通过初始相位锁定来获得、但精细的相位调整将会在蛋糕上带来额外的冰霜。

    再次感谢您的所有帮助和建议、

    - Ken
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    TI__Guru**** 2578945 points
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    Ken、

    感谢您的反馈、我很高兴这项工作能够成功。

    我将为此更新 TICSPro 和数据表。  我们所做的就是像这些那样排队等待错误并进入一个版本、因此可能在实际显示 Fosc%Fout 为类别2之前的一个月左右。

    至于 VCO_PHASE_SYNC=1时的 MASK_SEED 不稳定相移、我已经看到了这一点、并且还有一些限制。  当混料种子提供均匀增加的功能时、我没有巧妙的闭合形式解决方案、但我打算为同时使用的 MASK_SEED 和 PHASE_SYNC 添加此说明。

    使用 MASK_SEED 时有几个注意事项
    •相移可通过 FRAC_NUM=0实现、但 FRAC_Order 必须大于零。 原因
    FRAC_order=1、仅当 MASK_SEED 是 PLL_DEN 的倍数时、才会发生相移。
    •对于二阶调制器、PLL_N≥45、对于三阶调制器、PLL_N≥49和四阶
    调制器 PLL_N≥54。


    在 IncludedDivid>1的情况下使用 MASH_SEED 时，中还需要考虑几个附加注意事项
    以便使相移与 MASK_SEED 单调增加。
    •建议使用 mash_order <=2。

    当在低于10GHz (包括分频器= 6)或9GHz 的 VCO 频率下使用二阶调制器时
    (当 IncludedDivide=4时)、也许有必要将 PLL_N 值增加得多或者更改为优先
    调制器。 需要时、取决于 VCO 频率、包括分频器和 PLL_N 值。

    此致、
    Dean

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    TI__Guru**** 2578945 points
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    Dean、

    我相信、当 VCO_PHASE_SYNC = 1时、我已经符合您的 MASK_SEED 调整指南。 FRAC_Order = 2、PLL_N = 48。 VCO 频率为9600、ChannelDiv = 16且包括分频器= 4。 您能想到我可以转动的任何其他旋钮、以获得360度连续增加的相移吗？

    为了确保我触碰所有底座、我想向您询问有关 LMX2592的信息。 在这种情况下、增量相位延迟调整非常一致、我希望可以将其用于此应用、因为我可以将 VCO 运行在4800MHz 以下。 在相同的功率级别设置下、这使我的电流消耗比 LMX2594低约100mA。 假设 LMX2592没有 SYNC 函数、但无法将其配置为与输入时钟提供确定性相位关系、我是否正确？

    顺便说一下、我相信 LMX2592数据表第17页中的相移公式(1)存在优先级误差：

    相移(度)= 360×MUS_SEED×PLL_N_PRE / PLL_N_DEN /[通道分频器值] (1)

    末尾没有括号的双除法使我放弃了一段时间。 当我将该公式解释为类似于 LMX2594数据表中的公式(5)时：

    相移(度)= 360 *(MASK_SEED / PLL_N_DEN)*(PLL_N_PRE /通道分频器值)

    我得到了预期的相移。

    再次感谢、

    - Ken
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    TI__Guru**** 2578945 points
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    Ken、

    关于 LMX2592与 LMX2594数据表的比较、我认为它们是等效的、PLL_DEN 和[通道分频器值]都位于分母中、其余的内容位于分子中、但无论如何、LMX2594更清晰。

    关于相移、我注意到您低于10GHz。 回想一下我要添加的声明：

    "当 VCO 频率低于10GHz (包括分频器= 6)或9GHz 时、使用二阶调制器
    (当 IncludedDivide=4时)、也许有必要将 PLL_N 值增加得多或者更改为优先
    调制器。 当需要时、取决于 VCO 频率、包括分频器和 PLL_N 值。"

    现在、从技术角度而言、您的除法为4、并且您应该在高于9GHz 时正常工作、但这是我通过使用该器件找到的经验法则；我对此没有理论或设计依据。 因此、我知道的唯一方法是增加 N 分频器或将调制器阶数减小至1。

    此致、
    Dean