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[参考译文] CDC3RL02：数据表中的 CLDO 最小规格

admin
Guru**** 2513185 points


请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/clock-timing-group/clock-and-timing/f/clock-timing-forum/707901/cdc3rl02-min-spec-of-cldo-in-datasheet

器件型号：CDC3RL02

你(们)好  

我在 VLDO (引脚 B1)上使用2.2uF X5R 6V3 20%陶瓷电容器。

在~0deg C 的低温下、LDO 以~ 1.2MHz 的频率振荡、导致 CLK 输出上产生1.2MHz 的杂散。

我确信、在这个温度下、电容值仍然高于所需的最小值1uF。

CLDO 电容器上是否有最小或最大 ESR 要求？

谢谢你

Chris

  • 0
    TI__Guru**** 2513185 points
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    是的、CLDO 电容所需的最小 ESR 为100毫欧、以确保在 PVT 范围内 LDO 的稳定性。  芯片设计人员确认了这一点。

    Alan

  • 0
    TI__Guru**** 2513185 points
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    尊敬的 Alan：

    感谢您的回复。

    ESR 是否有最大限制？

    Chris

  • 0
    TI__Guru**** 2513185 points
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    CLDO 的 ESR 范围为100至1000毫欧(加上+/-20%容差)。  这可以通过使用用于 CLDO 的受控 ESR 电容器或通过添加与 CLDO 电容器串联的分立式电阻器来实现。

    此致、
    Alan