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[参考译文] LMX2572:LMX2572的 PLL 锁定时间

Guru**** 2585275 points
Other Parts Discussed in Thread: LMX2572, PLLATINUMSIM-SW

请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/clock-timing-group/clock-and-timing/f/clock-timing-forum/731240/lmx2572-pll-lock-time-of-lmx2572

器件型号:LMX2572
主题中讨论的其他器件: PLLATINUMSIM-SW

尊敬的 TI 专家:  

我们已按示波器测量了 LMX2572的 PLL 锁定时间、结果如下所示。

VCO 校准模式不提供任何帮助。

您能否帮助检查这些结果是否正确? 或接近您的测试结果?

如果您有任何 PLL 锁定时间的测试结果、您能与我们分享吗?  

非常感谢。

1。

fc = 1565MHz 跳至932.5MHz、PLL 锁定时间= 320uC

fc = 932.5MHz 跳至1565MHz、 PLL 锁定时间= 700uec

2.

fc = 4000MHz 跳至4600MHz、PLL 锁定时间= 580usec

FC = 4600MHz 跳至4000MHz、 PLL 锁定时间= 550 μ s

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    Derek、

    锁定时间取决于具体应用。  它随输入频率、相位检测器频率、PLL 环路带宽、VCO 校准设置和稳定容差而变化。  它可能在5us 至5000000 us 之间变化、因此没有一个简单的答案。

    话虽如此、对于具有默认环路滤波器的默认模式下的 EVM、我们的 PLLatinum Sim 工具预测约为160us、这主要取决于 VCO 校准时间。   然而、它与 PLL 的设置方式有很大的不同。

    您可以从 ti.com/tool/PLLATINUMSIM-SW 下载我们的 PLLatinum 仿真工具。

    此致、

    Dean