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[参考译文] CDCLVC1310：用于单端输入连接的外部上拉/下拉电阻器

admin
Guru**** 2560390 points
Other Parts Discussed in Thread: CDCLVC1310

请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/clock-timing-group/clock-and-timing/f/clock-timing-forum/682067/cdclvc1310-external-pull-up-down-resistor-for-single-ended-input-connection

器件型号：CDCLVC1310

大家好、

我对与的 LVCMOS 单端输入连接有一些疑问  
缓冲器。 请帮助我们回答以下问题；  

(1)如果要将单端 LVCMOS 输入连接到初级输入引脚、则  
通过选择引脚(00 (主输入模式)或选择哪种模式  
11 (XTAL 旁路模式))？  

(2)如果选择模式为00、那么次级输入引脚和 XTAL 引脚(XIN 和 XOUT)是否可以 保持悬空？  

(3)如果选择模式为11、那么初级和次级输入引脚能否保持 悬空？

(4) 如果单端 LVCMOS 输入连接到主输入引脚、在这种情况下、PRI_INN、SEC_INP、SEC_INN 和 XTAL 引脚的端接方案应该是什么？

(5)对于 LVCMOS 配置、在数据表中为 PRI_INP 和 PRI_INN 添加了上拉和下拉电阻器。 请解释这样做的原因。 可以避免吗？

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    TI__Guru**** 2560390 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

    您好、Megha、

    要将 LVCMOS 时钟输入 到 CDCLVC1310、

    (1)所有模式均可接受单端 LVCMOS 输入。 考虑到性能、首选00和01。

    00 PRI_IN：直流耦合。 请参阅下面的图3、但 不需要100 Ω 上拉/下拉电阻器。 请注意、引脚 PRI_INN 上需要外部偏置。

    01 SEC_IN：DC 耦合、它与00类似。

    10 XTAL 或 Overdrive：必须是 AC 耦合。 请参阅下面的图13

    11 XTAL 旁路：DC 耦合。 图13 C=0.1uF 应该是短的。

    ----------

    (2)是的。 如果选择模式为00、 次级输入引脚和 XTAL 引脚(XIN 和 XOUT)可 保持悬空。

    (3)是的。 所有未使用的引脚、如 X_INP、X_INN、XOUT 都可以悬空。

    (4)已回答上述问题。

    (5)使用100欧姆电阻器上拉和下拉：实现偏置电压 VDD/2、并实现匹配的端子负载50欧姆。 在图3中可以忽略它们。

    上拉并使用1k Ω 电阻器上拉：高速偏置电压 VDD/2。 在图3中不能忽略它们。

    此致、

    肖恩

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    TI__Guru**** 2560390 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

    谢谢 Shawn。 它解决了该问题。