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[参考译文] LMK05318B：250MHz 差分输入时钟面向 DPLL 相位和频率失锁

admin
Guru**** 2525490 points
Other Parts Discussed in Thread: LMK05318B, LMK05318

请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/clock-timing-group/clock-and-timing/f/clock-timing-forum/1183707/lmk05318b-facing-dpll-phase-and-frequency-loss-of-lock-for-250mhz-differential-input-clock

器件型号：LMK05318B
主题中讨论的其他器件： LMK05318

我们使用 LMK05318B 器件并为此器件馈送250MHz 差分时钟、并且在配置中启用了内部100欧姆端接、并且此路径上存在串联交流电容器0.1uF。

我们将在 运行期间观察 LOPL_DPLL 和 LOFL_DPLL 中断。 请告诉我们如何解决这个问题？ 我将 在 该 TT 中附加 e2e.ti.com/.../Gamora_5F00_PFE_5F00_LMK05318B_5F00_GEN2_5F00_PTP_5F00_rev4.tcs TCS 文件。

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    TI__Guru**** 2525490 points
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    您好 Murali、

    我们将查看配置并更新您。

    73、
    Timothy

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    如果我们将时钟频率更改为156.25MHz 而不是250MHz、则问题已解决。

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    TI__Guru**** 2525490 points
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    您好 Murali、

    您是否需要我们的进一步帮助？

    最棒的

    Andrea

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    对于我们的设计、该解决方案看起来不错。 从器件功能的角度来看、我想了解如果输入时钟频率为250MHz、LMK 时钟发生器是否能够清除时钟？ 该器件将在哪个时钟抖动上有效工作？

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    TI__Guru**** 2525490 points
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    您好 Murali、

    我不能说我遇到过太多抖动问题。  请注意、LMK05318B 通过了 G.8262抖动容差测试。

    由于存在无限数量的相位噪声曲线、这些曲线可能导致相同数量的抖动、更不用说不同的抖动积分范围。  就试图以太多抖动来断开器件而言、我认为这取决于噪声的实际位置。  由于抖动是相位噪声的积分、因此我预计它可能会在相同的"抖动"值下通过和失败、具体取决于噪声所在的位置以及您选择的积分带宽。

    那么、另一点是中断的定义。  例如，我可以想象一种情况，即 DPLL LOPL 变为无效，但它仍然有效地“锁频”--您可能可以放宽锁相阈值，使其不会使 LOPL 失效。

    抖动消除效果方面...

    • 当将 LMK05318用作 DPLL 时、抖动消除将发生在 DPLL LBW 之上、并且清理为用作 XO 输入的 XO/TCXO/OCXO 的质量。
    • 如果将 LMK05318用于时钟发生器(或仅使用 BAW 进行抖动清除)、则抖动清除将发生在 APLL1 LBW 以上。  通常、对于 PLL1 (具有 VCBO 的 APLL)、这大约为10kHz、但可以使用较低的电荷泵电流来缩小范围。

    希望这对您有所帮助。

    73、
    Timothy