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[参考译文] TPL5010:TPL5010时序

Guru**** 2563250 points
Other Parts Discussed in Thread: TPL5010

请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/clock-timing-group/clock-and-timing/f/clock-timing-forum/697773/tpl5010-tpl5010-timing

器件型号:TPL5010

我需要在断电~几分钟后生成电池断开信号。  

问题:

  1. RSTN 在上电期间是否保持高电平?
  2. 如果 VDD 上升速度非常慢、会发生什么情况?
  3.  是否有办法使 TPL5010上电、但不生成唤醒脉冲?

谢谢你

Michael

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    Michael、

    A1。 VDD 供电后、RSTN 为低电平。 RSTN 在读取外部电阻器的第一个读数并输出 RSTN 脉冲(t_Rext + t_RSTN)后变为高电平。

    A2,一旦 VDD 超过1.75V,该器件通常就会开始工作。

    答3. 如果在设定的时间间隔内未接收到 DONE 输入、则不会生成 WAKE 脉冲。

    此致、
    通道
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    谢谢你