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[参考译文] LMK04616:PLL2_RDIV 设置过程

Guru**** 2562120 points


请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/clock-timing-group/clock-and-timing/f/clock-timing-forum/695790/lmk04616-pll2_rdiv-setting-procedure

器件型号:LMK04616

大家好

我想知道 PLL2_RDIV 的设置过程。
我的客户选择分频器模式、值为2。
它们尝试设置以下两种模式。

案例1。  将设置值从1增加到2。
案例2。 将设置值从3减小到2。
PLL2被锁定在 case1上、而 PLL2未被锁定在 case2上。

[问题]
我现在不知道为什么 case2没有被锁定、所以请告诉我原因。
是否有任何 RDIV 设置程序?

请注意、
好的

e2e.ti.com/.../LMK04616-R_5F00_DIV-setting.pdf

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。
    你好、Sho
    您是否确保在将分频器从3更改为2时、所有其他分频器均已正确设置、以便 VCO 处于范围内?
    如果是这种情况、您是否在更改分频器后尝试复位分频器(RDIV 复位和 NDIV 复位)?
    请保存 PLL 未锁定的 TICSpro 文件并将其发送给我。
    此致
    Puneet
  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    您好、Puneet-San

    感谢你的答复。

    我将向您发送 PLL2未锁定的文件。

    请确认。

    此致、

    好的