从 CKPWRGD_PD#置为高电平到 SMB 可供访问所需的最短时间是多少?
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从 CKPWRGD_PD#置为高电平到 SMB 可供访问所需的最短时间是多少?
您好 Darren、
我能够获得有关您的查询的更多信息。 一旦 CKPWRGD_PD# 置为高电平、SMBus 接口就会启用、但响应可能取决于多种因素。
首先要考虑的是、如果这是冷启动还是热启动、因为冷启动所需的时间比热启动长、因为电路完全上电还有额外的延迟、EEPROM 会加载到寄存器中、从而增加该延迟。 对于热启动、不会发生额外的延迟。
接下来要考虑 的是、当 CKPWRGD_PD# 相对于电源电源被置位时。 如果 在电源斜坡后立即应用 CKPWRGD_PD#、则我们必须考虑冷启动延迟和 EEPROM 加载。 如果 在电源建立后长时间将 CKPWRGD_PD#置为有效、EEPROM 和冷启动延迟将会完成、因此您将获得更快的响应。
为了实现精确计时、我们需要了解实际用例场景、因为它也取决于输入频率。 但在一般情况下、如上所述、冷启动情况下可预期为300us、热启动情况下可预期为20us。
最棒的
阿西姆
您好、Asim、
感谢您提供信息。 多关注几个问题:
谢谢、
Darren
您好 Darren、
[引用 userid="550145" URL"~/support/clock-timing-group/clock-and-timing/f/clock-timing-forum/1188576/cdcdb400-smb-active/4487559 #4487559"]无论 是否 断言 CKPWRGD_PD#、在加电后内部 EEPROM 加载的最坏情况下延迟时间是多少? 请 用微秒量化。让我为您找到这个数字、因为我们必须为此运行仿真。
[引用 userid="550145" URL"~/support/clock-timing-group/clock-and-timing/f/clock-timing-forum/1188576/cdcdb400-smb-active/4487559 #4487559"]为什么时序取决于外部时钟频率?[/quot]当为器件加电以及当 CKPWRGD_PD#引脚设置为高电平时、会触发加电序列的不同部分。 上电序列包含4个计时器+ EEPROM 数据传输。 前两个计数器+ EEPROM 数据传输在片上"引导振荡器"上运行、其频率可能会有所不同。 最后两个计数器在输入时钟(CLKIN_P/N)上运行、该时钟的频率也会有所不同。 没有什么取决于 SMBCLK。 总之、EEPROM 数据传输持续时间(以及前两个计数器的持续时间)随着引导振荡器频率的降低而增加、最后两个计数器的持续时间随着输入时钟频率的降低而增加。
[引用 userid="550145" URL"~/support/clock-timing-group/clock-and-timing/f/clock-timing-forum/1188576/cdcdb400-smb-active/4487559 #4487559">您在语句中提到的输入频率:"为了精确计时、我们需要了解实际的用例场景、因为它也取决于输入频率。" 是 SMBCLK 频率还是 CLKIN_P/N 频率?[/引述]我指的是 CLKIN_P/N 频率。
[引用 userid="550145" URL"~/support/clock-timing-group/clock-and-timing/f/clock-timing-forum/1188576/cdcdb400-smb-active/4487559 #4487559"]内部 EEPROM 加载过程是否需要 SMBCLK 或 CLKIN_P/N 才能运行?[/quot]这不需要运行 SMBCLK 或 CLKIN、但我将确认这一点并返回给您。
最棒的
阿西姆
您好 Darren、
[引用 userid="521848" URL"~/support/clock-timing-group/clock-and-timing/f/clock-timing-forum/1188576/cdcdb400-smb-active/4489532 #4489532"]无论是否 将 CKPWRGD_PD#置为有效、内部 EEPROM 在加电后加载的最坏情况延迟时间是多少? 请以 微秒量化。
让我为您找到这个数字、因为我们必须为此运行仿真。
[/报价]我能够找到 EEPROM 最坏情况下的加载时间。 从施加的功率开始产生210us 的电流。
[引用 userid="521848" URL"~/support/clock-timing-group/clock-and-timing/f/clock-timing-forum/1188576/cdcdb400-smb-active/4489532 #4489532"]您在陈述中提到了哪种输入频率:"为了精确计时、我们需要了解实际用例场景、因为它也取决于输入频率。" 是 SMBCLK 频率还是 CLKIN_P/N 频率?
我指的是 CLKIN_P/N 频率。
[/报价]这包括"片上引导振荡器"和"CLKIN_P/N"频率、但 CLKIN_P/N 在此延迟中所占的时间较少。 其中大部分取决于 EEPROM 加载+前两个计数器(取决于引导振荡器频率)。
如果您有任何疑问、请告诉我。
最棒的
阿西姆
让我在这里改正我的发言。 这将是引导芯片振荡器频率。 CLKIN_P/N 频率 用于最后两个计数器 、该计数器用于控制数字逻辑从引导振荡器到输入时钟的切换。 如果 CLKIN_P/N 不存在、则不会发生此切换。 这些计数器对 SMBus 可用性没有任何影响。
启用 SMBus 所需的延迟主要由 EEPROM 加载和前两个计数器驱动。
我希望这澄清了这一点。 您能否帮助分享为什么需要这种精确的计时要求?
最棒的
阿西姆