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[参考译文] LMK03318:自动切换事件中的 PLL 解锁状态

Guru**** 1555210 points
Other Parts Discussed in Thread: LMK03318EVM
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/clock-timing-group/clock-and-timing/f/clock-timing-forum/1198555/lmk03318-pll-unlock-status-in-auto-switch-event

器件型号:LMK03318

您好!

 1.在数据表图43中、当基准输入从次级侧自动切换到初级侧时、PLL 是否会解锁?

 

图44中的流程图描述了当主输入无效时、当多路复用器自动切换到辅助输入时、PLL 应立即解锁。 当主输入有效时、多路复用器自动切换到主输入、然后 PLL 锁定到主输入。 在 PLL 锁定到主输入之前是否会发生一个短 PLL 解锁事件?

如果 R51.2设置为1、则在自动切换过程中不会看到任何 PLL 解锁事件。 因此、如果次级输入可用、并且 R51.2为1。 我不再需要担心 PLL 解锁事件、对吧?

2.在表8中,14号状态为“PLL secondary to primary switch in automatic mode”(PLL 从辅助到主开关处于自动模式)。 这是什么? 状态引脚在多路复用器自动切换到主输入后是否生成脉冲? 如果是、脉冲持续多长时间?

 

此致、

 

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    1. 如果初级输入也有效、则不会因基准开关而对输出产生毛刺脉冲。 基准必须在二次基准的2000ppm 之内才能被视为有效
    2. 状态多路复用器可以在生命体征表中设置为这些信号之一、但如果不需要此功能、则可以禁用多路复用器。
      1. 如果需要、则必须设置 STATUS0多路复用器以选择 STATUS0信号(R45[1:0]= 2)、然后 STATUS0信号必须设置为 自动模式下的 PLL 次级到初级开关(R27[7:4]、极性由位3设置)。 当这种情况发生时、会将状态0输出设置为高电平(或低电平、具体取决于极性位)。 我将检查这是仅用于开关发生时的周期、还是锁存。

    谢谢、

    Kadeem

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    Kadeem、

    1.我们希望使用此 PLL 解锁状态在自动切换事件发生时重置控制器。 但是、我觉得如果我设置 R51.2=0、当输入从初级侧切换到次级侧时、控制器应该被复位。 有一个 PLL 解锁事件。 但是,当输入从辅助切换到主控制器时,由于没有 PLL 解锁事件,控制器将不会复位。

    如果我设置 R51.2=1、则无论输入开关如何、都不应复位控制器、因为在开关过程中没有 PLL 解锁事件。

    如果我是对的、我更喜欢使用另一个状态信号来复位控制器、而不是 PLL 解锁状态。

    2.当开关发生时,我想确认这是否是脉冲信号。 我们不希望控制器始终复位,因为状态在切换发生后被锁存。 如果是脉冲、我更喜欢在主模式再次有效时使用"PLL 从辅助模式切换到初级模式"来复位我的控制器。

    此致、

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    我使用以下参考时钟设置了 LMK03318EVM:

    • PRIREF:25MHz 单端 LVCMOS 时钟
    • SECREF:25MHz 时的差分 XTAL

    我执行以下步骤:

    1. 配置 EVM、使 PRIREF 在 Out4上输出、SECREF 在 Out5上输出、PLL 在 Out6上以100MHz 的频率输出。
    2. 将智能多路复用器设置为自动选择 PLL 基准输入。
    3. 将 STATUS0信号设置为 SEC 至 PRI 开关上的输出
    4. PLL 锁定后、关闭 PRIREF 源。
    5. 将示波器设置为在 STATUS0上升沿触发

    我看到的是、当主基准被启用时、在状态引脚变为高电平之前、大约13个时钟周期通过。 状态引脚在大约200ns 内保持高电平、然后转换为低电平并保持低电平。 此外、在这种情况发生后大约1ms 内 PLL 输出不会静音、状态脉冲期间除外。  

    如果您要使用该信号进行复位、则在从 PRIREF 切换到 SECREF 时它不会触发复位、 在从 SECREF 切换回 PRIREF 时它会复位。

    如果您设置了静音旁路、 如果您希望 PLL 输出在此条件下继续、则应执行此操作、则输出仍处于活动状态、尽管它从100MHz 降至92MHz 至93MHz 之间。

    谢谢、

    Kadeem

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    Kadeem、

    谢谢你。 因此、SEC 至 PRI 开关将生成200ns 的脉冲。 如果我转换极性、我可以将其用作 RESET_n 信号。

    “此外,在这种情况发生后,PLL 输出不会静音大约1ms,状态脉冲期间除外。” 这意味着、PLL 在状态脉冲期间解锁? 如果 PLL 时钟降至92MHz、我认为它已解锁、对吧?

    此致、

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    我认为您在这里是正确的。  
    让我更正前面的措辞。 如果在开关事件期间输出被静音、那么当此开关发生时、输出时钟被禁用大约1ms、但状态0信号为高电平时除外。

    如果旁路了静音(如数据表中指定的那样)、那么 PLL 看起来像是被锁定在一个较低的频率上(它是在92MHz、但是恒定的)、然后在大约1ms 后返回到100MHz。

    谢谢、

    Kadeem