[参考译文] CDCE925：时钟信号排列和 ppm 误差

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https://e2e.ti.com/support/clock-timing-group/clock-and-timing/f/clock-timing-forum/1225677/cdce925-clock-signal-arrangement-and-ppm-error

器件型号：CDCE925
主题中讨论的其他器件：CLOCKPRO

我正在使用您的时钟专业版1.2.1软件来从10MHz 输入时钟生成三个时钟20MHz、7.3728Mhz 和30.72MHz、软件选择 CDCE925pwr 芯片并将这三个信号分配给 Y5、Y3和 Y1、误差全部为0ppm。例如、7.3728MHz 分配给 Y3 、包含"0 ppm"和"无 PPM 错误"消息、但如果我将 PDIV2也设置为25、与 PDIV3相同、Y2更改为7.3728MHz 、但其下的消息是"无限 ppm "和"0"、这是否意味着 Y2也具有0ppm 误差？

如果我使用软件向导来生成四个时钟20MHz、7.3728Mhz 和30.72MHz、7.3728MHz、软件可以从同一源同时生成30.72Mhz 和7.3728MHz、而不是同时生成两个7.3728MHz、有什么特别的原因吗？谢谢。

2 年多前

0 admin 2 年多前

TI__Guru**** 2378650 points

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哈利、您好！

ClockPro 是一款旧软件、我们计划在未来更新或替换它。 "PPM 错误"功能通常不准确、只要输出频率符合预期、我就不会太关注该特性；您可以使用"重置 PPM 基准"按钮消除该错误。

6259780 说：
如果我使用软件向导来生成四个时钟20MHz、7.3728Mhz 和30.72MHz、7.3728MHz、软件可以从同一个源同时生成30.72Mhz 和7.3728MHz、而不是同时生成两个7.3728MHz、有什么特殊原因吗？谢谢。

我已经对此进行了尝试、在本例中、ClockPro 从同一源生成了2x 7.3728MHz 和1x 30.72MHz：

在结构上、Y2和 Y3配对、以便它们需要来自同一个源(PLL1输出或基准旁路)、并且 Y1不与任何东西配对。但在当前的多路复用器设置下、Y1 + Y2 + Y3全部来自 PLL 1的输出、因此应该不会出现问题。

此致！

Evan Su

时钟和时序（参考译文帖）

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[参考译文] CDCE925：时钟信号排列和 ppm 误差