[参考译文] LMK05028：时钟相位抖动

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请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/clock-timing-group/clock-and-timing/f/clock-timing-forum/1211124/lmk05028-clock-phase-jitter

器件型号：LMK05028

您好、E2E 专家！

你好。

被测器件(DUT)是具有单端时钟输入的 ASIC。我们正在尝试使用 LMK05028最大程度地减少任何时钟相位抖动。

我们应该将 OUT0时钟驱动器配置为单端还是输出差分、并使用缓冲器转换为单端吗？

2.是否有建议的电源/接地方案可以帮助最大限度地减少任何潜在的相位抖动？

从布局的角度来看、LMK05028和 DUT 之间可能有一英寸。

此致、

CSC

2 年多前

0 admin 2 年多前

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您好、CSC、

您需要什么频率输出以及您要寻找的抖动集成度是多少？该典型的 FOM 积分是从12kHz 到20MHz 还是另一个特定区域？

您可以参阅数据表： https://www.ti.com/lit/ds/symlink/lmk05028.pdf?ts=1680225315584&ref_url=https%253A%252F%252Fwww.ti.com%252Fproduct%252FLMK05028 以了解布局指南。

-Riley

0 admin 2 年多前

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您好 Riley：

你好。

请在您的‘中定义‘FOM’。我们所需的输出频率为100MHz、必须将其相位锁定到100MHz 的输入频率。它们是相同的、这是个巧合。

此致、

CSC

0 admin 2 年多前

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您好、CSC、

FOM 是品质因数。我想知道什么是抖动积分。通常、我们对数据表测量使用集成范围12 kHz - 20 MHz。

在更接近偏移时、LVCMOS 可能具有更好的噪声性能、而在更高/进一步的偏移区域中差分输出更好。

您是否有100MHz 输出尽力满足的特定抖动要求？

-Riley

0 admin 2 年多前

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您好 Riley：

你好。

具体而言、我们希望 OUT0-OUT3 抖动小于10皮秒。

其他问题：如果我们希望锁相到的 IN0信号具有1Hz 的频率漂移、OUT0-OUT3上是否会发生这种情况？它们是否会跟随频率漂移、还是仅保持锁相并保持在内部设置的频率？

此致、

CSC

0 admin 2 年多前

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您好、CSC、

我们的器件可生成具有~150fs RMS 抖动的100MHz 时钟。

是的、如果输出锁定到 IN0、它们将遵循该基准的漂移。

-Riley

时钟和时序（参考译文帖）

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