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[参考译文] CDCLVP111-SP:关于 LVCMOS 输入的另一个问题

Guru**** 2382480 points
Other Parts Discussed in Thread: CDCLVP111
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/clock-timing-group/clock-and-timing/f/clock-timing-forum/1259529/cdclvp111-sp-yet-another-question-about-lvcmos-inputs

器件型号:CDCLVP111-SP
主题中讨论的其他器件:CDCLVP111

对于以前关于单端输入的问题、我们的回答还不够充分。 一个桥臂的最大 VID 是1.3V 是真的吗、这样该器件将被如图所示连接的3.3V 单端输入损坏。 8? 或者、由于该器件未经单端输入测试、且该设计能够承受更大的摆幅、这只是特性限制吗?

如果确实存在损坏风险、数据表图8 (如下所示)会具有很大的误导性。 它仅适用于1.2V LVCMOS 输出、这在振荡器中很少见。 但我怀疑1.3V 是否真正阈值、在该阈值下、器件将开始出现问题。

另一个问题:在数据表中、CLKn 的 VCM 最小值为1V。 另一个问题/回答指出、单端输入必须满足这一要求。 如果需要分压、这似乎与上面的图完全相矛盾。 为了说明明显性、将 LVCMOS 信号分压到1.3V 将具有0.65V 的 VCM、这小于1V。 调节这将需要增加交流耦合+直流偏置。 请解释这些不一致之处。

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    您好、Azad、  

    如果 VID 超过1.3V、器件不应损坏、因为它仍处于输入引脚的绝对最大额定值范围内。  

    从我通过浏览原始验证数据可以看出、设置 VID 和 Vcm 限值是为了表征目的、而不是为了检查功能。 采用 LVPECL 输入时、器件的性能很可能优于 LVCMOS、因此在执行表征工作时很可能会考虑到这一点。 表6.6中的 VID 特性仅适用于 LVPECL 标准/特性、因此对于 LVCMOS 输入、可以忽略这些特性。 我建议尽可能使用2.5V 或3.3V LVCMOS 输入、以确保 VTH > 1V、因为我找不到有关使用较低共模电压运行器件的信息。 请注意、原始 CDCLVP111发布于大约15年前、很难找到 一些信息、因此您可能会在不同的 E2E 线程上看到一些相互矛盾的信息或困惑。 请告诉我这是否解答了您的问题。  

    此致、  

    康纳  

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    感谢 Connor,这是我希望得到的合理答案。 我感谢您的澄清! 这就是用太空级部件设计的困难:)