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器件型号：CDCLVP1102 嗨、团队，
2024新年快乐！
我的客户正在考虑使用 CDCLVP1102、并有一些需要回答的问题：
1.能否提供推荐的应用原理图？
客户需要两个输出同时到达设备。 两个输出通道之间的延迟时间是多少？
3.有没有类似的车规级芯片可以推荐? 采样时间和大规模生产时间？
谢谢！
嗨、团队，
2024新年快乐！
我的客户正在考虑使用 CDCLVP1102、并有一些需要回答的问题：
1.能否提供推荐的应用原理图？
客户需要两个输出同时到达设备。 两个输出通道之间的延迟时间是多少？
3.有没有类似的车规级芯片可以推荐? 采样时间和大规模生产时间？
谢谢！
林国海
1. EVM 用户指南的第6节 显示了 EVM 原理图、是一个很好的起点。 数据表中的第9.1节 还提供了有关典型应用的更多信息。
2. 两个输出通道之间的延迟时间为10ps，TI 将其称为 CDCLVP1102的"输出偏斜"。 如果您确实需要 0输出偏斜的输出、则有更复杂的具有输出延迟功能的时钟发生器可生成完全同相且没有任何感知 偏斜的输出。
3.我们目前不提供任何汽车类 LVPECL 时钟缓冲器。 但是、如果您不需要 LVPECL、则有4路输出 LVCMOS 和 HCSL 汽车级时钟缓冲器。 LMK00804B-Q1 和 LMK00334-Q1 。
此致、
将会