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[参考译文] CDCE6214-Q1:CDCE6214-Q1原理图审阅

Guru**** 2390160 points
Other Parts Discussed in Thread: CDCE6214-Q1
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/clock-timing-group/clock-and-timing/f/clock-timing-forum/1320922/cdce6214-q1-cdce6214-q1-shcematic-review

器件型号:CDCE6214-Q1

  帮助查看原理图,如何端接   LPHCSL 输出(添加串联电阻器、交流电容器?),谢谢。

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    Peter、

    通常、0欧姆电阻器与输出时钟串联、以允许换出不同的值、从而改善阻抗匹配或振幅衰减。  

    确保 REFSEL 被拉至低电平、以选择 SECREF 作为输入时钟。
    我们建议使用额外的铁氧体磁珠+电容器来将 VDD_VCO 与其他 VDD 域隔离。

    谢谢。

    卡德姆

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    谢谢,

    当把 SECREF 用作时钟,如何处理 PRIREF 引脚5和引脚6?

    2.对于连接到 SSD 的时钟输出(MTFDHBL128TDQ-1AT12ATYY)PCIe 参考时钟,我们是否需要在 SSD 侧添加100 Ω?

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    Peter、

    当只使用 SECREF 时、PRIREF 引脚可保持断开状态。

    CDCE6214-Q1的输出是 LP-HCSL、而不是 HCSL、因此  50 Ω 不需要连接到 GND 的终端电阻器。

    谢谢。
    卡德姆