[参考译文] LMK5B33216：禁用时的 HCSL 输出引脚状态

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https://e2e.ti.com/support/clock-timing-group/clock-and-timing/f/clock-timing-forum/1373376/lmk5b33216-hcsl-output-pin-state-when-disabled

器件型号：LMK5B33216

工具与软件：

团队成员、您好！

我对 LMK5B33216 HCSL 输出有疑问。

禁用时、我希望器件输出为固定状态、正电压为高电平、负电压为低电平。

然而、我认为当被禁用时、两个 Pos/Neg 引脚的器件输出为0V。

有没有好的方法可以实现这一点？

此致、

1 年多前

0 admin 1 年多前

TI__Guru**** 2387830 points

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大家好、有人可以支持吗？

此致、

0 admin 1 年多前

TI__Guru**** 2387830 points

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尊敬的 Taketo-san：

我对延误深表歉意。让我明天检查一下。

此致、

Jennifer

0 admin 1 年多前

TI__Guru**** 2387830 points

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你好、Taketo、

仅当启用 CMOS 缓冲器时、OUT0和 OUT1才支持将单个 P 和 N 设置为高电平或低电平。其他输出只能设置为禁用(P 和 N 为0V)。

此致、

Jennifer

0 admin 1 年多前

TI__Guru**** 2387830 points

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您好、Jennifer San、

感谢您的评论。

Unknown 说：
其他输出只能设置为禁用状态(P 和 N 均为0V)。

P 和 N 为0V、而不是高阻态、因此在禁用时用于修复其状态的外部电路(如上拉/下拉)也不起作用、对吗？

此致、

0 admin 1 年多前

TI__Guru**** 2387830 points

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你好、Taketo、

正确。禁用状态不是高阻态、因此上拉/下拉将不起作用。

此致、

Jennifer

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