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[参考译文] LMX2594:各种频率下的杂散。

Guru**** 2013480 points
Other Parts Discussed in Thread: LMX2594, PLLATINUMSIM-SW
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https://e2e.ti.com/support/clock-timing-group/clock-and-timing/f/clock-timing-forum/1456067/lmx2594-spurious-at-various-frequencies

器件型号:LMX2594
主题中讨论的其他器件: PLLATINUMSIM-SW

工具与软件:

您好!

我正在研究 lmx2594合成器 IC、我正在馈送100 MHz 参考时钟。  将合成器配置为10.5GHz。 我在这里面临的问题是以及我配置的频率、我将在其他频率获得具有75 dB 推理的峰值。 我还附加了图像、供您参考。 我为什么会得到这样的假象? 是否有可能降低杂散的功率。

提前感谢您的支持。

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    您好!

    团队正在美国度假-请预计在1/2/26之前得到回复。

    谢谢!

    Kadeem

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    您好、Aand:  
    您能否共享您的配置(.tcs)文件?  
    您可能有一些串扰杂散、因此我们需要了解合成器的配置方式以及我们是否可以消除这些杂散。  
    很多时候、由于频率计划、无法消除某些杂散。  
    降低 CP 增益有助于减少杂散峰值、因此这是一种选择、但首先请分享您的配置。  

    此致、  

    Vicente  

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    您好

    我们正在使用我们自己的 python 程序来创建配置文件。 我在此附加了要用于配置的配置文件。  e2e.ti.com/.../5000.txt

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    尊敬的 Anand:  
    我有点困惑-您曾提到将器件配置为10.5GHz 输出  
    在导入到 ticspro 后发送的配置中、我看到了5G 输出。  
    您上传的规格图还显示了10.5G 载波。  

    此致、  

    Vicente  

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    您好

      很抱歉给您带来不便。 我连接10.5 GHz 配置。 e2e.ti.com/.../10500.txt

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    您好

    我只想提醒你这个问题。

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    Anaand、您好!  
    您是否有任何方法可以提供.tcs 文件?  
    我在导入时收到此消息。  

    我还看到以下错误:  

    此致、  

    Vicente  

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    Anand、

    如果您有100 MHz 输入参考、则会与载波混合并产生100 MHz 杂散。  此外、如果您的相位检测器也是100 MHz、这会增加杂散功率。  ti.com/tool/PLLATINUMSIM-SW 上的 PLLatinum Sim 工具预测杂散。  -75 dBc 似乎在工具预测的范围内。

    为了缓解这些杂散、以下几点为:

    1. 尝试将相位检测器更改为200 MHz (如果尚未更改)。  这样、您可能会得到更强的200 MHz 杂散、但会得到更弱的100 MHz 杂散

    2. 可能会发现对输入基准有一定的敏感性。  如果您使用压摆率更快但振幅更低的东西、例如 LVDS、它可能会将它降低几 dB。

    此致、
    Dean

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    、您好!

         感谢您的答复。 从我共享的图像以及100MHz 杂散、我还在50MHz 得到了杂散。 我不明白为什么会出现这种情况?

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    尊敬的 Anand:

    如果配置如下所示、则50MHz 杂散可能是小数杂散。

    您可以将 FPD 降低至100MHz、消除50MHz 杂散。

    我有其他建议给你。

    -将通道 B 更改为 VCO 输出

    -降低电荷泵电流应减少100MHz 杂散

    -锁定后,设置 R2[10]= 0以关闭内部状态机时钟。 这也可以减少100MHz 杂散。 VCO 校准需要状态机时钟、因此在进行 VCO 校准之前、应启用该位、使其恢复为1。