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[参考译文] CCStudio-Sitara:在CCS11中启用DDR

Guru**** 1993015 points
Other Parts Discussed in Thread: SYSCONFIG
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/tools/code-composer-studio-group/ccs/f/code-composer-studio-forum/1091852/ccstudio-sitara-enabling-ddr-in-ccs11

部件号:CCStudio-Sitara
Thread:sysconfigTMDS64GPEVM中讨论的其它部件

我正在尝试在 TMDS64GPEVM上启用DDR。 我已使用sysconfig在CCS上启用了它。 当我尝试调试时,收到以下消息:

MAIN_Cortex_R5_0_0:GEL输出:已通过GEL发出CPU重置(软重置)。
MAIN_Cortex_R5_0_0:在长度0x1000的第0页0xa410万处写入内存块时出现问题:(错误-1065 @ 0xA410.1万)无法访问设备内存。 验证内存地址是否在有效内存中。 如果错误仍然存在,请确认配置,关闭电源后重启板和/或尝试更可靠的JTAG设置(例如,Lower TCLK)。 (仿真软件包9.5 .0.0.0143万)
MAIN_Cortex_R5_0_0:文件加载器:验证失败:目标写入0xA410万失败
MAIN_Cortex_R5_0_0:GEL:文件:C:\projects\FDIC\FDIC\Debug\FDIC.Out:加载失败。

我有几个问题:

我看到了一个或多个应运行的脚本文件的引用。 我的Code Composer中的“脚本”选项为空。 脚本文件存储在何处?

地址 0xa410万应该是DDR的开头,但应该比0x1000大得多。 这种价值来自哪里?

与启用DDR相关的任何其他内容。

此致,

Lee Thalblum

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    抱歉,第二次查看时,地址0xA410万来自哪里? 这似乎不是主域内存映射的一部分。

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    您好,Lee,

     

    为了初始化DDR内存,您可以 按照  dev.ti.com/.../node上提供的MCU+ SDK手册的入门-> EVM设置-> AM64X EVM ->附加详细信息-> SOC初始化->使用CCS脚本进行SOC初始化中提及的步骤进行操作

     
    请告诉我这是否解决了问题。



    Address  0xa410万应该是DDR的开头,但应该比0x1000大得多。 此值来自何处?[/QUOT]

    让我验证一下并回复给您。

    此致

    Rajat Batra

     

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    您好,Rajat:

    我查看了您参考的文档的“DDR初始化”部分。 它使用特定的脚本文件。 正如我在原帖中提到的,我的CCS的Scripts (脚本)菜单选项为空。 在哪里可以找到应该有的脚本?

    此致,

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    您好,Lee,

      上述文档的一节(使用CCS脚本进行SOC初始化->设置环境变量)中所述,您需要将MCU+ SDK的根路径添加到环境变量中,然后CCS应该能够获取脚本。

    请注意,脚本仅在您将调试器连接到皮层R5后才会显示在脚本菜单下,如一节中所述 (使用CCS脚本进行SOC初始化-> 运行SOC初始化脚本)  

    此致

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    您好,Rajat:

    这似乎解决了问题。 我现在可以加载和调试。 感谢你的帮助。

    此致,

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    快速跟进问题:脚本中包含的配置信息来自最终版本代码的什么位置? 是在发行版构建期间从syscfg生成的代码中添加该代码,还是最终发行版构建不需要该代码?

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    您好,

    在生产版本中,SBL应在加载应用程序映像之前初始化DDR。

    此致

    拉贾特  

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    您好,Rajat:

    感谢您的回复。

    此致,