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[参考译文] DAC39RF10EVM:有关 TI204C-IP 的问题

Guru**** 2378640 points
Other Parts Discussed in Thread: DAC39RF10EVM
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/1487838/dac39rf10evm-question-about-ti204c-ip

器件型号:DAC39RF10EVM

工具/软件:

尊敬的 TI 团队:

您好!我发送电子邮件询问 TI204C-IP。 我计划使用64b66b JMODE10将 DAC39RF10EVM 连接到 VCU118、并通过16个通道将2通道12位数据输出到 DAC。 数据采样速率为5GSPS。

使用收发器向导、我生成了两个8通道内核。 我分配了以下通道:

  • 内核1: X0Y4、Y5、Y8、Y9、Y10、 Y11、Y12、Y13
  • 核心2: X0Y14、Y15、Y24、Y25、Y28、 Y29、Y30、Y31

您能否确认此配置是否正确? 此外、时钟分为两个系统:Bank120,121,122和 Bank125,126、来自不同的 SLR。 但是、Bank122在 Core 1和 Core 2之间共享。 这会导致任何问题吗?

由于 DAC39RF10EVM 在这些条件下可以连接到 TSW14J59板、因此如果您能说明它们的实际连接和运行方式、我将不胜感激。

此外、根据参考设计、我尝试在上述设置下仅实现具有8个通道的内核1。 不过、在置为无效后 TX_SYNC_RESET 电子邮件 MASTER_RESET_n TX_LANE_DATA_READY 不置为有效、数据传输不开始。

此外、当我设置时 NUMBER_OF_REFCLK_BUFFERS 至1、然后 number_of_quads 至3、 qpll1_locked 仅返回1。

能否就这些问题提供指导?

我感谢您的支持、并期待您的答复。

此致、

选项卡

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    尊敬的 Tabe:

    我建议创建一个16通道 JESD IP、而不是两个8通道 IP 内核。 这是因为不容易在两个内核之间共享一个四通道/组。 每个内核为自身生成一个单独的收发器、这将锁定 QPLL 和存储体。

    您看到 QPLL1_LOCKED 返回0x1的原因是因为收发器的参考时钟输入将是一条三位总线、并且您有一个单基准时钟缓冲器。 在这种情况下、您需要将同一缓冲时钟连接到所有三个基准时钟输入。 您可能已直接连接它、因此只有最低的四通道模块会获取参考时钟(因此只有 PLL 被锁定)。

    此致、
    阿米特

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    尊敬的 Amet:

    很抱歉我迟到的答复。 我认为 JESD IP 限制为8个通道。

    目前、DAC39RF10EVM + VCU118设置位于客户现场、因此我无法直接对其进行测试。

    在能够实现后、我将返回结果报告。

    此致、

    选项卡