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器件型号：ADS1251 主题： ADS127L11中讨论的其他器件
工具/软件：
数据表指出、标称 CLK 和 SCLK 输入电压为0.6V、但未指定允许的最小值或最大值。 如果微控制器偏离了正常配置、并向时钟引脚施加 CLK/逻辑高电平、而不是向~0.6V 振幅的时钟信号施加 CLK/逻辑高电平、是否会对 VCC 或 SCLK 引脚造成损坏？
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数据表指出、标称 CLK 和 SCLK 输入电压为0.6V、但未指定允许的最小值或最大值。 如果微控制器偏离了正常配置、并向时钟引脚施加 CLK/逻辑高电平、而不是向~0.6V 振幅的时钟信号施加 CLK/逻辑高电平、是否会对 VCC 或 SCLK 引脚造成损坏？
尊敬的 Elias Tarver：
我懂了。
我可以在 ADS1251数据表中找到的与 SCLK/CLK 相关的0.6V 规格是关于迟滞的规格。 请参阅下图。 这是您所指的吗？
请注意、在这些引脚上施加的最大电压由 V_IH 给出、可高达电源电压(VDD)。 此外、还应注意、最大 V_IL 为0.8V、因此施加0.6V 振幅时钟信号就像对 ADC 的恒定0一样
-布莱恩
