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[参考译文] AFE11612-SEP:DAC CLR 延时

Guru**** 2374090 points
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/1508992/afe11612-sep-dac-clr-latency

器件型号:AFE11612-SEP

工具/软件:

与此屏幕截图关联的加载条件是什么?

 DAC 输出达到其新值负载所需的速率是2.5V/秒、还是由压摆率或 DAC 输出缓冲器视频 BW 等因素决定?  能否通过缓冲 DAC 输出来隔离负载来缩短上升/下降时间?

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    您好、Peter:

    这是一个空载 DAC。  RL = 2 kΩ、CL = 200 pF 负载时、2.5V 变化的标称稳定时间为3us、因此2.5V/us 空载可能是 DAC 缓冲器可以输出的最快速度。

    谢谢、
    Erin