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[参考译文] ADC09DJ1300-Q1：对布线长度有何要求？

admin
Guru**** 2361380 points
Other Parts Discussed in Thread: ADC09DJ1300
请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/1518553/adc09dj1300-q1-what-are-the-requirements-for-wiring-length

器件型号：ADC09DJ1300-Q1
主题：ADC09DJ1300中讨论的其他器件

工具/软件：

您好、专家

布线长度有哪些要求？
1)哪些信号线需要等速配线?
・D0±～D3±
・TRIGOUT±
・CLK±
・SYSREF±
・SYNCSE~
2)对于等轴测配线而言、1毫米或更小的精度是否足够？
3)接线长度的限制是多少?

对于子类0、以下要求是否正确？
・D0±=D1±=D2±=D3±=TRIGOUT±≤30～100mm？ (例如)
・不需要 SYNCSE~

对于子类1、以下要求是否正确？
・D0±=D1±=D2±=D3±=TRIGOUT±≤30～100mm？ (例如)
・CLK±=SYSREF±≤30～100mm？ (例如)
・不需要 SYNCSE~

使用条件：
在1：1处使用 ADC09DJ1300和 TI-JESD204c-IP (Release-v1.10-latest)
JESD-link-parameters 为 FS=1.25Gsps、JMODE9、Linerate=6.25Gbps

谢谢你。

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    TI__Guru**** 2361380 points
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    在以下三种配置中考虑了 Suclass0和 Subclass1。

    谢谢你。

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    TI__Guru**** 2361380 points
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    你好 Mitsuo

    每个信号的差分对内应尽可能匹配长度。 JESD 通道对间不需要匹配、因为 JESD 协议将处理这些差异。

    发送到多个 ADC 的时钟信号可根据需要尽可能紧密匹配、因为时钟的差异将导致 ADC 与 ADC 的采样时间略有不同。

    谢谢、

    Eric

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    TI__Guru**** 2361380 points
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    您好、Eric

    感谢您的答复。
    我们将匹配每个信号的对内长度。
    我目前不打算使用多个 ADC、因此我将询问另一个时间。

    让我再检查一下。

    即使是子类0 (不带 SYSREF 的 JESD-TX 和 RX)、是否也不需要匹配 JESD 通道对间的对？

    当您说 JESD 协议处理 JESD 通道对间的差异时、这是否意味着 ADC09DJ1300和 TI-JESD204c-IP 将处理该差异而无需用户配置？

    谢谢

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    TI__Guru**** 2361380 points
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    您好 Mitsuo、

    是、即使对于子类0、您也不需要匹配 JESD 通道对间、协议也可以在没有用户配置的情况下处理此问题。

    谢谢、

    Eric

  • 0
    TI__Guru**** 2361380 points
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    您好、Eric、

    我知道弹性缓冲器会吸收这种情况。 我看到数据表6.3.4.5.4.4初始通道对齐序列(ILAS)和6.3.4.5.6物理层中提供了相关说明。

    谢谢、