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[参考译文] DAC39RF12：DAC39RF12EVM、ADC12DJ5200SE 和 TSW14J59EVM — 用于波形生成和波形捕获的 FPGA 文件

admin
Guru**** 2361250 points
Other Parts Discussed in Thread: TSW14J59EVM
请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/1517219/dac39rf12-dac39rf12evm-adc12dj5200se-and-tsw14j59evm---fpga-files-for-waveform-generation-and-waveform-capture

器件型号：DAC39RF12
主题：TSW14J59EVM 中讨论的其他器件

工具/软件：

你（们）好  

我最近购买了这些产品。 我将它们连接到 FPGA 评估板 (TSW14J59EVM)。 您能否请共享 Vivado 工程文件来加载数据以及捕获此类数据。 我们是否需要购买 JESD204C 许可证才能运行文件？

此致

Venu

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    TI__Guru**** 2361250 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

    有关 Vivado 工程文件的任何设置配置帮助、以下是我感兴趣的配置。

                JESD204b/C 8b/10b
    JESD 配置     DAC 模拟参数     Jmode 2.
    更新速率 12g   Mxmode DES2XL 或 DES2XH   通道/流 4.
    通道数 4（2 个 IQ 对）   DDS 已启用 2.   Lanecount 16
    进行内插 6.   DUC 格式 也复杂得多   LMFS 16-4-2-4
    输入数据速率 2Gbps   启用倍流器 是的   Lr 10Gbps
    输入 BW 800MHz         内核时钟 125MHz
    JESD 子类模式   1.         SERDES 时钟 125MHz
                Sysref K 64
                Sysref 频率 7.8125MHz

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    TI__Guru**** 2361250 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

    Veny、

    请访问以下链接、从 TI 申请 JESD204C-IP。  

    https://www.ti.com/drr/opn/TI204C-IP