This thread has been locked.

If you have a related question, please click the "Ask a related question" button in the top right corner. The newly created question will be automatically linked to this question.

[参考译文] AFE7900EVM:AFE7900 EVM 与 ZCU102 连接

Guru**** 2361250 points
Other Parts Discussed in Thread: AFE7950EVM, AFE7900, AFE7900EVM, AFE7950
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/1509004/afe7900evm-afe7900-evm-link-with-zcu102

器件型号:AFE7900EVM
主题中讨论的其他器件:AFE7900AFE7950、AFE7950EVM

工具/软件:

我们有一个 AFE7900 EVA 板、并将其放入 Xilinx ZCU102 FPGA 板上、TI FAE 为我们提供了一个演示 zip 文件、该文件已在其他客户中进行演示。 我们将这个演示文件导入到 Xilinx Vitis 中、 然后重新编译并运行它、它可以正常工作、UART 日志中未显示错误。

我们只能在 Vitis 中看到 C 代码,无法看到任何硬件代码。 因此、我们尝试自行重建 FPGA 的硬件代码、并运行相同的 C 代码。 但我们收到了一些 UART 日志错误、如附件所示:AFE7900EVA+Zcu102_err.png

我们的硬件方框图如附件所示: ZCU102_PL_PL_pl.png Block_Diagram。

您能检查一下这里有什么问题吗?

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    您好 Henry:

     启动 文件是否有任何更改? 您能否确认您正在使用 AFE7900EVM? 第 9 行中失败的重新检查用于检查 AFE7900 和 AFE7950 之间的故障、并报告 AFE7950 的芯片版本。  

    如果您使用 AFE7950EVM、则需要专门为 AFE7950 生成新日志、此问题就会解决。

    此致、

    David Chaparro  

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    您好、David、  

     感谢您的回复、您是对的、我们使用了 ZCU102 Link 与 AFE7950EVM、并收到了此错误。您会建议如何 专门为 AFE7950 生成新日志吗? 使用 Latte?  

    后来、我们获得了 AFE7900EVM 并以相同的方式进行了尝试。 它显示另一个错误消息。 请参阅以下内容。

      

    请问您有 什么问题吗?

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    您好 Henry:

    若要为 AFE7900EVM 生成日志、您可以在未连接 EVM 的情况下打开 Latte 软件、并按照正常的启动过程操作。 这会将 SW 置于模拟模式、然后您可以按照下面链接的应用手册的第 9 节运行脚本以生成配置文件。  

    https://www.ti.com/lit/ug/sbau412a/sbau412a.pdf 

    关于您看到的错误、您能否确认在对 AFE 进行编程之前 Master_RESET_n 和 TX_SYNC_RESET 都已退出复位状态?  

    此致、

    David Chaparro  

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    您好、David、  

     几天前、我们购买了 AFE7900 EVA 板、当我们使用   TI 提供的原始文件(包括 xsa 和 C 文件)重新编译 Xilinx 工程时、 可以使用 ZCU102 运行演示、 但我们无法使用 TI 提供的 JESD_204C IP 重新编译相同的硬件文件。  

    我们已经尝试按照 “ 使用 Xilinx FPGA 启用 AFE79xx SPI 指南“的说明重新编译 Xilinx 硬件、 但未能使用 ZCU102 进行演示。

     如果我们更改 sedes lane pin 的映射顺序、您会建议如何配置您的 JESD_204C IP 并重建硬件文件 (xsa) 吗?  

    或者、您是否请提供 使用 ZCU102 重新构建 Xilinx 硬件以实现演示的详细步骤。  

    -亨利-