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[参考译文] ADS1285:SYNC 和 SPS

Guru**** 2577385 points
Other Parts Discussed in Thread: ADS1285

请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/1572536/ads1285-sync-and-sps

器件型号:ADS1285


工具/软件:

大家好:

 

我使用三个 ads1285 对两个 gephone 传感器进行采样、因此我使用同步信号+多路复用命令。

 

我的输出数据是 sinc 滤波器、因此当 SPS=256 (8kHz) 时、得到的值约为 1.2KHz。

 

我们的客户要求“四舍五入“数字、例如 1KHz:我能否实现这个目标?

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    你好 Massimo、

    欢迎来到 TI E2E 社区。

    您能解释一下“1.2kHz"的“的含义吗?  这是有用的输入信号带宽吗?

    工作速率为 8ksps、sinc 滤波器的–3dB 带宽将为 1.632kHz。  您可以通过调整时钟频率来调整该频率。

    fCLK=1kHz/1.632kHz 8.192MHz = 5.0196MHz

    此外、ADS1285 sinc 滤波器仅适用于与限制输入带宽的额外外部滤波器配合使用。  FIR 滤波器的有效带宽为数据速率的 0.375 倍。

    此致、
    Keith Nicholas
    精密 ADC 应用

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    您好 Keith Nicholas 

    在下图中、您将找到一些说明

    我们有一个用于激活 SPI ss(SPI 并行)的移位寄存器 (SR)

    D0 是 SPI 时钟、后跟 SR 信号。 最后一个时钟“尖峰“是用于切换另一个输入端多路复用器的命令

    最后两个是 drdy 和同步(脉冲模式)。 在该图中、我们将在每个其他活动之前激活 SYNC、但如果我们在更改多路复用器后移动 SYNC、也会发生同样的情况。

    如您所见、在两个 drdy 之间、有 817us = 1.2KHz(612Hz/输入)。

    我们的客户需要 500 Hz 或 1 KHz 等整数、因此问题是:我能否实现这个目标?

    谢谢你

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    你好 Massimo、

    当您更改输入通道、然后发送同步脉冲时、这会复位内部数字滤波器、该滤波器需要超过 1 个数据速率周期才能稳定(sinc 滤波器在 5.5 和 6 个数据速率周期之间,但我没有确切的数字)。  我认为这是您观察到的行为。

    ADS1285 典型用例从单个通道读取多个转换结果、在这种情况下、数据速率如数据表中所示。  如果您更改时序以在多路复用器更改后以 1000us 的间隔发送同步脉冲、则可以实现精确的 1ksps 数据速率。  换句话说、无论 ADC 数据速率设置如何、您都可以通过同步周期来控制数据速率。

    此致、
    Keith

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    您好 Keith、

    假设我想要 1000 μ s。

    如果我在该周期使用 SYNC、则第一个 DRDY#中断将在 SYNC 817us 之后发生、然后在 125us 之后、由于我设置 DR=256 -> 8kHz、将有另一个中断。 这种解决方案不适用于我们的应用。

    替代方法:更改输入后、我将 SYNC 置为有效、但现在我必须在 1000-817=183us 时再次将 SYNC 置为有效。 这是解决方案吗?

    此致

    Massimo

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    你好 Massimo、

    您确实会在建议的时序中获得一个额外的 DRDY。  您需要忽略该额外的读数、发送多个同步脉冲或降低时钟频率。

    选项 1: 发送 额外的 SYNC 脉冲示例

     发送同步脉冲(开始 1000us 帧)

    2. 等待 DRDY 为低电平

     在不到 125us 的时间内、读取转换结果、更新寄存器设置(包括多路复用器)、并发送额外的同步脉冲。

    4. 从第一个同步脉冲总共 1000us 后、重复步骤 1-4。

    选项 2: 忽略其他 DRDY

     发送同步脉冲(开始 1000us 帧)

    2. 等待 DRDY 为低电平

     3.读取转换结果、更新寄存器设置、包括多路复用器。

     4.忽略下一个 DRDY

    5. 从第一个同步脉冲总共 1000us 后、重复步骤 1-5。

    选项 3:使用较低频率的时钟源、例如 fCLK=CLK 7.3728MHz。  初始延迟现在将是 908us、然后是数据周期 139us。

     发送同步脉冲(开始 1000us 帧)

    2. 等待 DRDY 为低电平

     在不到 92us(总共 1000us - 908us 延迟)的时间内、读取转换结果、更新寄存器设置、包括 MUX。

    4. 从第一个同步脉冲 A 总共 1000us 后、重复步骤 1-4。

    此致、
    Keith