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[参考译文] ADS54J60:获取&&39;X'

Guru**** 2891410 points

Other Parts Discussed in Thread: ADS54J60

请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/1642650/ads54j60-getting-x

部件号: ADS54J60

您好、

即使我将所有信号提供给 Vivado 2022.2 中的收发器向导 IP、我也会得到“x“值。我们需要一些有关此方面的帮助、并且 我们 正在使用 xc7a200fbg484-2 FPGA。

 

此致、

M. Alekhya

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    您好 — 您能帮助提供您的 LMFS 配置和采样率吗? 您是否使用 TI 提供的 JESD IP?

    您是否能够将器件置于传输层测试模式以测试链路的完整性?

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    参数 数据值 为什么
    l 每通道 4(共 8 个) JESD_A[3:0]+ JESD_B[3:0]-每个 ADC 通道 4 个通道
    m 2. 两个模拟输入:CH-A (INAP/INAM) 和 CH-B (INBP/INBM)
    f 1. f =(M×NP)/(8 × L)=(2 × 16)/(8 × 4)= 每帧一个八位位组
    s. 2. S =(F× 8 × L)/(M×NP)=(1 × 8 × 4)/(2 × 16)= 1(在基座上) 、但 ADS54J60 在 250ms/s 下输出 S = 2
    k 32 ADS54J60 固定默认值;多帧= F×K = 32 个八位位组
    N 16 ADS54J60 本机 16 位分辨率
    Np. 16 N = NP—无需填充

    采样频率为 480MSPS

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    如果您使用的是 TI 提供的 JESD IP、您还可以回答 Alekhya 吗?

    如果您将器件置于传输层测试模式、您是否能够在 FPGA ILA 中看到预期的符号?

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    很抱歉晚才回复。 是的、我使用 TI 提供的 JESD IP。 然后是。 如果不是、原因是什么?

    此致、

    M. Alekhya