[参考译文] DAC39RFS10EF：用于 DAC39RFS10EF 子类 0 系统的 PLL

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Other Parts Discussed in Thread: DAC39RFS10EF, LMX1204, LMK04208, LMK04828, LMX2594, LMX2820

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https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/1656559/dac39rfs10ef-pll-to-use-for-dac39rfs10ef-subclass0-system

器件型号： DAC39RFS10EF
主题中讨论的其他器件： DAC39RFS10、 LMX1204、 LMK04208、 LMK04828、 LMX2594、 LMX2820

大家好

我们正在研究 EF 的参考设计。在我们的目标应用中、我们只有一个转换器系统：Kintex 7 FPGA --> DAC39RFS10EF。根据我的理解、subclass0 JESD204 架构就足够了。

我们打算在 8 个通道上运行最大 6.6Gbps（FPGA GTX 限制）、以实现大约 2GSPS 和 4GSPS 之间的采样率（而在 64b/66b 下、3.878GSPS 似乎是 EF DAC 的最大值）。

在该参考设计中、我发现使用了强大且昂贵的 PLL、例如 LMX1204 和 LMK04828。对我来说、它们似乎对我们的应用来说是一个大材小用。我们还可以使用 LMK04208 吗？它没有专用的 SYSREF 输出、抖动略差。

另一个问题：我们是否以 1：1 采样率为 DAC 提供最佳时钟？即在 3.2GHz 下、还是使用 DAC 的内部 PLL 是合理的？也许后者的性能较差？实际上、我看到 LMK04828 和 LMK04208 都超过 3.07GHz。这会将采样率限制在 3 GSPS 吗？

3 个月前

0 admin 3 个月前

TI__Guru**** 2964790 points

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大家好、这方面有什么更新吗？

谢谢、Adrian

0 admin 3 个月前

TI__Guru**** 2964790 points

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DAC39RFS10EF 没有内部 PLL、因此需要外部时钟。 LMK 会限制 DAC 的输出频率、还请注意相位噪声会严重降级。我们建议使用 LMX1204 之类的器件、因为它的附加相位噪声非常低、这不会降低 DAC39RFS10EF 的性能

0 admin 3 个月前

TI__Guru**** 2964790 points

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您好 Bill

感谢您的答复。这是对我的一个误解、当时 DAC39 有一个内部 PLL。

因此、使用任何支持 JESD 的 LMX 系列 PLL 都适合我们的应用？如前所述、FPGA 上只有一个 DAC、子类 0 就足够了。 3-4GHz 的采样率是可以的、因为我们仍然使用 DAC39 的 EF 导出友好版本来限制此速率。那么、LMX2594 或 LMX2820 呢？但是、我认为 JESD 支持似乎指的是 SYSREF 生成、因此甚至可能不需要？

数据转换器（参考译文帖）

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