“线程: 测试”中讨论的其它部件
主席先生,你好,
我有一个用 ADS62P48设计的老设计(5年),它在使用 CMOS IQ 总线的100Msps 上运行良好。
现在,我需要将采样提升到200MSPS,同时将此设计的变化降至最低。
我用一张卡片测试它,改变合成器频率,所有这些似乎都很好。
CLKOUT 引脚具有较小的逻辑电平,1.2Vpp 而不是1.8Vpp...
阅读(数据表中的第7页第11页)时,CMOS 模式下的 CLKOUT 有150Msps 限制...
请您详细解释为什么存在此限制?
对我来说,一个小的改变是将快速缓冲器放置在尽可能靠近 CLKOUT 引脚的位置。
你感觉如何?
此致,
阿兰。