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我无法从 DAC获得任何输出。 DAC和FPGA之间的JESD链路似乎同步,但DAC不输出任何数据。 即使SPIDAC_Test寄存器用于绕过JESD链路,DAC也不会发出任何信息。
我也无法 更改页面顺序寄存器的值。 无论将什么值写入页面顺序寄存器,它始终读取2。 我能够写入其他寄存器并验证数据是否在更改,以便SPI接口看起来工作正常。 即使发出SPI重置,它也不会将页面集寄存器的值从2更改为2。
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我无法从 DAC获得任何输出。 DAC和FPGA之间的JESD链路似乎同步,但DAC不输出任何数据。 即使SPIDAC_Test寄存器用于绕过JESD链路,DAC也不会发出任何信息。
我也无法 更改页面顺序寄存器的值。 无论将什么值写入页面顺序寄存器,它始终读取2。 我能够写入其他寄存器并验证数据是否在更改,以便SPI接口看起来工作正常。 即使发出SPI重置,它也不会将页面集寄存器的值从2更改为2。
Seth,
我重复了您的设置并在下面添加了与您的设置不匹配的注册设置:
地址值
090000
008000
013080
005803 5800
02 FFFF
03 FFFF
090004
0A FC03
0B 0022
0C A002
0D F000
1b 0000
23 FFFF
241001.
310200 3000
320308
3.3403万C
34万
350018
3B 1001.
3c 8029.
3D 0088
3e 0929.
3楼0000
090001
0A 0C10
0C 26A02622
0D 0000
0E 00FF
0f FFFF
10 FFFF
11 FFFF
17万
190001
1c 0000
1d 0000
1E 5555.
1楼5555
20 55D5
210000
220000
230000
240010
25 2a00
278888
280330
290000
2A 0000
2B 0000
2C 0000
2D 1FFF
2E 1FFF
2F 0000
300000
320400
330400
46.0044万.
4.719万A
48 31 C3.
4A 0102 0802
4B 1303.
4C 1300
4D 0100
4e 0F0F
4F 1C60
500000
5.1001万F
52 00FF
530100
54 8E60
5C 0001
5e 0000
5F 0123 3210
604567 5764
64万
65万
660000
67 0.087万 A
680000
690000
6A 0000
6b 0000
6C 0000 1000
6D 0000
090002
0A 0C10
0C 26A02402
0D 0000
0E 00FF
0f FFFF
10 FFFF
11 FFFF
17万
190001
1c 0000
1d 0000
1E 5555 0
1F 5555 0
20 55D5 0
210000 0
220000
230000
240010
25 2a00
278888
280330
290000
2A 0000
2B 0000
2C 0000
2D 1FFF
2E 1FFF
2F 0000
300000
320400
330400
46.0044万.
4.719万A
48 31 C3.
4A 1002 4002
4B 1303.
4C 1300
4D 0100
4e 0F0F
4F 1C60
500000
5.1001万F
52 00FF
530100
54 8E60
5C 0001
5e 0000
5F 0123 3210
604567 5764
64万
65万
66 0.087万 A
67万
680000
690000
6A 0000
6b 0000
6c 0000
6D 0000
090001
240000
5C 0000
090002
240000
5C 0000
090004
0A 5C03
0A 7C03
090000
004003
090001
240030
5C 0002
090002
240020
5C 0003
090000
006000
此致,
Jim