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[参考译文] ADC12D1600：AC耦合CLK+/-丢失时DCLK+/-的状况

admin
Guru**** 2386610 points
Other Parts Discussed in Thread: ADC12D1600
请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/587469/adc12d1600-condition-of-the-dclk---when-the-ac-coupled-clk---was-lost

部件号：ADC12D1600

您好，

我的客户有关于ADC12D1600的问题。

[Q]

请告诉我AC耦合CLK+/-丢失时DCLK+/-的状况。

(高？ 或低？ 或未定义状态？)

此致，

Hiroshi Katsunaga

  • 0
    TI__Guru**** 2386610 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

    您好，Katsunaga-san

    此ADC产品系列具有极高增益时钟接收器电路。 由于该功能与交流耦合时钟输入相结合，当输入偏置为0V时，器件将打开CLK+/-输入上存在的少量噪声。 自切换的确切频率很难预测，但在应用时钟时，其频率低于设备的正常工作频率。

    由于设备是自动计时，因此在这种情况下将切换DCLK输出。

    避免这种情况的最佳方法是在时钟关闭时断言ADC断电控制。

    此致，

    Jim B

  • 0
    TI__Guru**** 2386610 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。
    你好，Jim-San，

    感谢您的快速响应和清晰答案！

    好的，我理解你的所有评论。

    感谢您的合作。

    此致，
    Hiroshi Katsunaga