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[参考译文] ADS1292:ADS1292的输出数据出现问题

Guru**** 2562120 points
Other Parts Discussed in Thread: ADS1292

请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/615800/ads1292-a-problem-with-the-output-data-of-ads1292

部件号:ADS1292

大家好:

当我尝试通过MCU读取ADS1292的72位数据时遇到了问题。 问题在于我试图更改  CH1SET的寄存器参数,输出数据始终是 FF C0 0 0 1 80 0 FF。 通道1似乎已关闭,数据 已脱位。  当我检查电路时,我发现 IN3N和IN3P连接到AGND而不是AVDD。  以下参数是我的配置。

ADS _REG (WREG|CONFIIG1,0X01);  
ADS_REG (WREG|CH1SET,0x00);  
ADS_REG (WREG|CH2SET,0x00);  

ADS_REG (WREG|RLD_SENS,0x23);
ADS_REG (WREG|RESP2,0X07);  

ADS_REG (WREG|RESP1,0X02);

希望你们能帮我 解决这个问题。谢谢!

此致,

Chris

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    您好Chris,

    通道1输入的输入电压是多少? 您是否能够读取寄存器设置以确认它们是正确的值?

    此致,
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    您好,Ryan:

    感谢您的帮助!

    我发现DRDY信号的输出波形有问题。 一个读出周期中有两个方波,就像这样。

    此致,

    Chris

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    Chris您好-设备开机后,您是否看到正常的/DRDY模式? /DRDY应以默认数据速率进行脉冲。 SCLK的第一个上升边缘强制/DRDY清除高电压。 如果您不读取数据,则/DRDY将在下一个样本准备就绪之前,在低值空闲并返回高值几个tCLK周期。

    您能否共享SCLK,/DRDY,/CS和DOUT的捕获?

    此致,
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    您好,Ryan:

    很抱歉回复您太晚了。

    我似乎选择了错误的DRDY边缘 来读取数据, 我使用MCU外部中断来捕获 DRDY的上升边缘。

    此致,

    Chris

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    您好,Chris:

    您当时是否解决了问题? /DRDY的下降沿是MCU用作外部中断的正确边缘。

    但是,我想知道为什么/DRDY在/CS处于低位之前从低变为高?

    此致,