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[参考译文] DAC3162:‘DACA'和‘DACB'之间的输出延迟问题

Guru**** 1187730 points
Other Parts Discussed in Thread: DAC3162, DAC3484, THS3217
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/641035/dac3162-output-delay-issue-between-daca-and-dacb

部件号:DAC3162
主题中讨论的其他部件: DAC3484THS3217

您好,

我的客户正在使用DAC3162 (500Msps),并面临以下问题。 请帮助尽快获得答案。 他们希望明天就能得到答案,因为PCB计划已过期。

在其系统中,DAC3162和LCOS显示屏共享附加结构图中的'LVDS Lcoslk 120MHz'。

LCOS面板需要获得DAC3162的‘DACA'和‘DACB'对齐的模拟输出信号,以获得清晰的图像(1080p 120fps), 但是,输出图像由于数据A和B处理时间之间的延迟而被DAC3162的输出失真,如下图32所示(如下所示)。

 

另一个问题是IOUTP和IOUTN的输出范围过低,约为0.5V。 LCOS面板需要使0V至6V峰值到峰值。 因此,它们正在使用外部运算放大器(MAX228)来充分输出大约12倍的DAC。 他们希望了解如何提高DAC3162的输出电平,以及如何获得0V至6V模拟输出的应用说明。

如果可以解决此问题,他们还希望获得有关1Gsps双通道DAC的建议。

  

1. 我们使用双通道输出DAC3162。 我们刚刚注意到模拟输出端口A和B的半时钟相位关闭。

   对于我们的应用,端口A和端口B的输出应该对齐。

   请告知我们如何解决此问题。

 

2.   DAC3162的输出范围为0.5Vpp,带直流偏移电压。

    我们需要将DAC输出信号从0.5Vpp放大到6Vpp,摆幅为0V至6V,偏压为3V。

   您是否可以对获得6Vpp的应用电路提出任何建议?

此致,

Shaka Lee

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    Shaka,

    让客户用B数据交换A数据,并了解这如何影响偏移。 按照设计,零件应使两个通道同时输出相同的样品。 即使数据在不同时间计时,内部计时也将为此进行调整。

    此致,

    Jim  

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    您好,Jim:

    感谢您的回答。 他们已经尝试交换A数据和B数据,但结果相同。 请告诉我有关调整内部计时的详细信息吗? 数据表中没有信息。 您能否告知我们如何利用当前的硬件做得更好?

    正如下面FPGA中2通道至1通道LVDS缓冲器的模拟一样,FPGA在A和B上输出相同的数据。在此模拟中,输出时钟偏移90度。

    如果此问题未解决,他们还会考虑使用DAC3484来替换DAC3162。 是否有办法单独调整或延迟DAC输出?

    此致,

    Shaka

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    Shaka,您好!

    我正在研究从0.5Vpp到6Vpp的DAC3162输出放大,并应尽快返回解决方案。

    此致,

    Rohit  

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    Shaka,您好!

    我认为下面的THS3217电路可用于将DAC3162输出从0.5Vpp放大到6Vpp。 左侧盒上是DAC3162输出模型,提供0至20mA输出电流和5pF输出电容。

    DAC3162和THS3217之间有一个170MHz DAC重建Bessel滤波器,用于滤除DAC谐波。 我认为1080p 120fps所需的信号链BW为~140MHz。 因此,滤波器中的170MHz BW应该足够好。 但是,如果这不是正确的BW,请告诉我,我们可以调整L和C值以获得正确的BW。

    另一件事是,如果您计划使用DAC3484而不是DAC3162,则THS3217的接口电路将发生变化。  

    此致,

    Rohit

    瞬态响应:

    频率响应: