[参考译文] ADS1274：ADS1274更低的数据速率，有效位计算，参考电压和抗锯齿滤波器实现

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部件号：ADS1274
主题中讨论的其他部件： THS4521， OPA1632， ADS1278， THS4561， THS4551， THS4541

您好，

我叫Idan，是以色列航空工业(IAI)的电子工程师。

在我的应用中(在多传感器链系统中有数千个单元)，我需要从3个不同的通道测量非常小的输入信号，几乎有效的24位-同时采样(从±3V，平衡差分，每个输出0.15V至3.15V，1.65V零-参见图1)。为此，我曾考虑使用ADS1274 24位，4通道，同步采样，24位，Δ-Σ ADC，但为了实现此目的，我需要您回答以下问题：

1. 根据数据表中的表7和表8，只需使用100kHz外部时钟(100k/512=195.3SPS-对于高分辨率模式)，此器件就可以在~200SPS的条件下使用，并且规格和性能保持不变。我对吗？只使用不同的时钟值？

2. 此ADC的有效位分辨率是多少(~52kSPS和~200SPS)？如何计算？

3. 假设我将使用一些高性能，全差动运算放大器来驱动西格玛增量ADC (例如OPA1632或THS4521…)，则可以使用3V参考来驱动具有2.5V共模的ADC (来自来自放大器的Vcom)。增益1-参见图2了解第一个放大器之后的ADC输入信号)，对吧？

4. 实施一阶反锯齿滤波器的正确方法是什么？ (在驱动到输入ADC的输出ADC之间，我猜是…Ω)。在哪里可以看到该实施的一些示例(可能在某些EVM原理图中)…

非常感谢

e2e.ti.com/.../ADS1274-Queation.docx

Idan

7 年多前

0 admin 7 年多前

TI__Guru**** 2390755 points

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您好Idan：

感谢您对我们的ADS1274的关注！

ADS1278中给定模式的性能在可接受的CLK输入范围内保持大致相同。 ADC噪声性能将略有变化。数字滤波器的密码带随数据速率而扩展。因此，当您降低输入CLK频率时，数据速率和数字滤波器带也会降低。较小的有效噪声带宽将在较低的CLK频率下略微提高噪声性能。
有效分辨率的计算公式为：log2[ 2*Vref / VN_rms ]。
是的，2.5 －V共模非常适合您的应用。我假设放大器电源和ADC模拟电源(AVDD)都是5V？ ADC的输入共模电压可以独立于参考电压进行设计。重要的是，差动输入电压的绝对值必须小于参考电压，以便ADC进行正确的转换。对于VREF = 3 V，每个ADC输入可以从[ADC V - 1.65 V]摆动到2.5 V + 2.5 1.65 V]。与THS4521属于同一产品系列的一些较新器件包括THS4541，THS4551和THS4561。
一级差动滤波器将由每个输入的串联电阻器和两个输入之间的差动电容器组成。切断频率应比数字滤波器密码带多大约十年。此电容器还用于为内部采样电容器提供电荷，因此通常建议至少使用100倍采样。滤波器电阻器应保持相对较小(即小于50欧姆)以在保持放大器稳定性的同时最大程度地减少增益错误。

此致，

数据转换器（参考译文帖）

数据转换器（参考译文帖）(Read Only)

[参考译文] ADS1274：ADS1274更低的数据速率，有效位计算，参考电压和抗锯齿滤波器实现