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[参考译文] ADS1278EVM-PDK:SPI MSB要到SPI传输的第一个下降边缘之后才会超频。

Guru**** 2587365 points
Other Parts Discussed in Thread: ADS1278

请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/646900/ads1278evm-pdk-spi-msb-is-not-getting-clocked-out-on-until-after-the-first-falling-edge-of-the-spi-transfer

部件号:ADS1278EVM-PDK
主题中讨论的其他部件:ADS1278

您好,

我在使用ADS1278的SPI接口时遇到问题。

根据数据表,数据MSB已准备就绪,可在DRDY*下降边缘之后,在CPU上进行一个CLK周期时钟。 使用25MHz外置时钟时,如果SPI传输在DRDY*下降边缘之后至少延迟40ns,CPU应该能够对具有第一个SPI clk上升边缘的MSB进行时钟。

但是,数据行继续显示从最后一个传输的单词开始的LSB数据级别,一直到DRDY*脉冲,直到SPI传输的第一个下降沿,才会更改为新的读数MSB。 所以我的所有读数都比前一位差了一点。

 

有什么想法我可能做错了什么?

谢谢!

Bob

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    Bob,您好!

    感谢您的帖子。

    我假设通道2上的CLK是主时钟输入,而通道10上的CLK是接口的SCLK? 如果是这样,我同意有些东西是不正确的,因为数据应该随着/DRDY的下降边缘而移动。 你说如果你把数据向左移一点,结果是否合理?

    您显示的这一/CS信号是什么? ADS1278没有/CS引脚。

    我确实注意到帧同步格式计时图显示,SCLK在帧的开头呈高渐变和低转换状态,与FSYNC上升沿对MSB进行计时。 让我与一位设计师确认,它确实是/DRDY下降边缘,而不是第一个SCLK下降边缘,它以SPI格式为MSB计时。

    此致,
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    您好,Ryan:

    感谢你的帮助。
    通道2是主时钟。 它与信道10上的SPI时钟同步。
    SPI MOSI通过Miso向与ADS1278 ADC的读取同步的DAC芯片写入。
    通道9上的CS*用于DAC写入,它未连接到ADC,仅显示为标记SPI传输的开始和结束。

    WBR,
    Bob
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    Bob,您好!

    输入电压是正电压还是负电压? 如果是正数,MSB将为0。 这可能与前一个数据字的LSB一致。 您是否可以强制输入电压为负值,使MSB为1? 然后,我们可以确定是否存在问题。

    我确实让设计师确认RTL代码显示,MSB被/DRDY下降沿计时结束。

    此致,

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    您好,Ryan:

    原始屏幕截图是单个扫描轨迹。 当您在示波器不断重新触发时查看它时,数据线会随着前一个数据字的噪声LSB在1和0之间不断切换。 我目前没有设置它来拍摄另一个屏幕快照,但它看起来像这样。 MSB是数据就绪上升边缘之后的下一位,它跟随输入电压,并且它是坚如磐石的,在1和0之间没有任何闪烁。

    这是一个成熟的芯片,所以我希望您的数据表和您的工程师都是正确的,但这仍然令人困惑。

    谢谢!

    Bob

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    今天早上我尝试重新创建我的测试,而我发现了与您的工程师描述的一样的东西。 DRDY*的下降边缘上的数据线正在更改,以匹配要传输的下一个单词的MSB。 通过调整输入电压,我可以将其设置为高或低。

    感谢你的帮助。

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    Bob,您好!

    我很高兴您能够在设置中确认这一点。 如果您需要其他任何信息,请告诉我们。

    此致,