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[参考译文] ADC12D1620QML-SP:ECE模式下的校准引脚设置

Guru**** 2589280 points
Other Parts Discussed in Thread: ADC12D1600QML-SP, ADC12D1620QML-SP

请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/654952/adc12d1620qml-sp-cal-pin-setting-in-ece-mode

部件号:ADC12D1620QML-SP
主题中讨论的其他部件:ADC12D1600QML-SP

您好,

数据表建议将CAL引脚保持在高位,以减少SEU导致校准循环的可能性。

我的设计仅使用ECE连接,其余的CTRL引脚通过电阻器向下/向上拉。

1.由于CAL引脚和CAL位是逻辑ORED,这是否意味着为了启动校准,我需要先将PIN和位设置为LOW,然后再设置High?

2.是否有方法可以在不需要控制CAL位的情况下遵守建议(并使用上拉电阻器将其设置为高)?

3.地球同步轨道上的预期校准欧盟标准值是多少?

此致,

Itai

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    您好,Itai:

    我们正在研究您的问题,并将很快回复您。

    此致,
    Neeraj
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    您好,Itai

    1.如果客户系统没有激活的CAL引脚控制,则应将其绑在低位。

    然后,在正常操作中可以将CAL位设置为1。

    要启动校准周期,可以将CAL位设置为0,在Tcal_l的最短持续时间内保持在该级别,然后再设置回1。 0->1转换将启动校准周期。

    2.我们没有用于校准系统的单独的SEU数据。

    此致,

    Jim B

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    您好,Itai

    ADC12D1600QML-SP请参阅报告,网址 为:http://ieeexplore.ieee.org/document/700.4591万/?reload=true

    本文档同样适用于ADC12D1620QML-SP,该产品共享相同的刀版和CCGA封装。 这两种器件之间的唯一区别在于ADC12D1620QML-SP上改进的封装基板设计,它提高了ADC动态性能(SNR,SFDR,THD),特别是在较高的输入频率下。

    此致,

    Jim B