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[参考译文] ADS42JB69:SYNC~信号设置和保持时间要求

Guru**** 2601915 points
Other Parts Discussed in Thread: ADS42JB69

请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/665038/ads42jb69-sync-signal-setup-and-hold-time-requirements

部件号:ADS42JB69

你好,

我们的系统使用多个ADS42JB69器件,并使用JESD204B子类1实现多芯片同步。 输入时钟和SYSREF信号均已对齐,并且符合SYSREF相对于输入时钟的设置和保持时间要求。 据我所知,LMFC周期现在应该都处于阶段。

要启动CGS和ILA序列,应分别断言和断言SYNC~信号。 我们可以在相应的LMFC周期内轻松地在所有设备上实现这一目标。 在ADS42JB69数据表的图74和75中,给出了与输入时钟相关的SYNC~信号的设置和保持时间要求。

如果SYNC~信号可应用于LMFC周期内的所有设备,是否需要满足这些设置和保持时间要求?

此致,
Francois Tolmie

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。
    您好,Francois,

    我们正在研究您的问题,并将很快回复您。

    此致,
    Neeraj
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    您好,Francois
    只有在ADS42JB69以子类0或子类2模式运行时,才需要图74和75中所示的SYNC~到CLKIN的设置和保持时间。
    对于SYSREF的子类1操作,SYNC~到CLKIN定时限制较小,您只能满足LMFC定时。
    此致,
    Jim B