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[参考译文] ADS1292:检查SCH参考TI设计和简化

Guru**** 2551110 points


请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/598683/ads1292-check-sch-reference-the-ti-design-and-simplify

部件号:ADS1292

您好,戴尔斯,

我们参考 了TI的设计和简化,可能需要您的专业支持,我们需要最小的PCB,如果您有一些想法,请提供参考,tks~

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    您好,Huixin,

    可能需要串联拆下电阻器? 基本上,您可以拆下8个电阻器。 所有MCU (根据我的经验)在启动后都具有输入配置中的所有GPIO (如果未禁用)。 因此,如果您对编码很小心,删除它们不会造成伤害。

    R77怎么样? 如果始终连接到MCU,则也可以将其删除。

    如果AFE始终使用内部时钟,则可以删除CLK连接。 这是一个高频轨道,在您的小型设计中,我想如果不需要,您可能不会选择跟踪它。 也可以拆下起始销的连接。 这可以释放PCB上的一些空间。 我想功耗对您来说也很重要,因此您应该保持PWDN连接,以便能够将IC断电。

    还有一件事。 我注意到VCAP1和VCAP2连接到数字接地。 我想应该使用模拟接地来绕过它们。
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    您好Huixin:

    原理图几乎功能正确。 但是,针脚13需要连接至负极电源。 现在它是浮动的。 参考Vala的评论,应将VCAP引脚与模拟接地分离。

    在优化方面,您应将串联电阻器保留在输入上以进行抗锯齿。 数字I/O上的串联电阻器也是不必要的。 Vala是正确的;无需将起始引脚连接到主机,因为您可以使用start命令控制转换。 只需将起始销连接到地面即可。 您是否计划使用内部时钟? 如果是这样,CLKSEL引脚始终保持高位,CLK引脚可能保持浮动状态。 GPIO引脚上不需要电阻器。

    Brian
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    感谢Brian澄清我的评论。 对于串联电阻器,我肯定不是指模拟路径中的电阻器。 我指的是那些连接到MCU的线路。