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[参考译文] ADS1298R:ADS1298 DRDY signal problem,I am非常焦虑

Guru**** 2457760 points
Other Parts Discussed in Thread: ADS1298

请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/594832/ads1298r-ads1298-drdy-signal-problem-i-am-very-anxious

部件号:ADS1298R
在“线程:ADS1298”中讨论的其他部件

我现在使用FPGA控制ADS1298开发板,首先配置电源进行初始化,然后配置寄存器,最后转换数据并接收。
问题是1。 DRDY‘s周期不稳定,抖动非常强大,导致输出数据错误,如何稳定DRDY周期?
             2.数据表显示,DRDY信号在SCLK的第一个下降边缘被拉高,但我应该何时给出SCLK信号?

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    平阳您好!

    1. 您能否在示波器或逻辑分析仪上捕获此行为以便我查看?
    2. 在DRDY从HIGH (高)变为LOW (低)并确认CS之后,您可以切换SCLK。 设备通过使DRDY从nigh变为low来指示新数据,因此等待DRDY变低后,您将收集最新的转换数据。

    Brian