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[参考译文] ADC12DJ3200EVM:用于ADC12DJ3200EVN的KCU105 FPGA设计

Guru**** 2359480 points
Other Parts Discussed in Thread: ADC12DJ3200, ADC12DJ3200EVM
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https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/1094366/adc12dj3200evm-kcu105-fpga-design-for-adc12dj3200evn

部件号:ADC12DJ3200EVM
主题中讨论的其他部件:ADC12DJ3200

您好,

我使用的是KCU105和 adc12dj3200evm。  TI网站上ADC12DJ3200/Xilinx KCU105设计的当前版本是通过Vivado 16.1 完成的。  JESD连接器的许可证只能返回到Vivado 16.4。  您是否可以将您的设计更新到最新版本的Vivado?  我有通过Vivado 2023获得的JESD核心Good永久许可证,但我无法在我的设置中运行您的示例版本,我认为这与许可证有关。

如有任何其他帮助,我们将不胜感激。

哈利

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    您好,Harry:

    我能够将项目升级到Vivado的2020.2 版本,并且可以使用以下链接下载升级后的文件。 请注意,此参考设计是由不再支持固件的第三方创建的,因此我们只能针对与此项目相关的任何问题提供最低限度的帮助。

    https://tidrive.ext.ti.com/u/_ojtJG0I7RbsiO0j/036b170d-49da-47bd-91ab-c6b3.94324734亿?l 

    要获得更深入的帮助,我建议使用TI的TI204c-IP: https://www.ti.com/tool/TI-JESD204-IP 

    此致,

    David Chaparro  

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    您好,David, 您知道这在硬件中是否有效吗?  我也可以升级文件,但我的项目在硬件中无法正常工作。

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    您好,Harry:

    我只尝试升级项目,因为我没有要测试的硬件。 在测试更新的项目时,您是否收到任何错误?

    此致,

    David Chaparro

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    我无法让数据流过设计。  我有一个KCU105和ADC。  但是,当我执行所有步骤来设置设计,下载位文件并配置ADC时,我没有得到数据,帧同步总是很低,但时钟被锁定。

    我创建了一个设计,它的配置与示例完全相同,结果也相同。  我知道,根据Xilinx的说法,当使用subclass0时,你不需要使用sysref,所以我在设计中不使用它。

    我将立即下载您的设计,并让您了解一下。

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    我刚下载了设计,但无法使用。 除了KCU105上的一个闪烁灯外,我几乎到处都能看到所有的0。

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    哈利,

    对ADC和KCU105编程时,您是否遵循了固件附带的说明? KCU105专为6Gbps的信道速率而设计,并且支持JMODE0和JMODE2,因此ADC设置应与此匹配。

    此致,

    David Chaparro