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[参考译文] ADC09SJ1300：关于FPGA选择的SerDes数据速率

admin
Guru**** 2964790 points

Other Parts Discussed in Thread: ADC09SJ1300

请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/1102365/adc09sj1300-about-serdes-data-rate-for-fpga-selection

部件号：ADC09SJ1300

大家好，

我的客户想评估一下，当ADC09SJ1300以1.3Gsps的高采样率运行时，SerDes的数据速率将是多少。 它们将使用四个SerDes通道(L=4)。 这是为了选择合适的低成本FPGA。 他们想知道JESD204B和JESD204C的最大数据速率(L=4)。

谢谢。

  • 0
    TI__Guru**** 2964790 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

    您好，Jerry：

    JMODE15将为您提供每个通道四个通道，这些通道将是您的所有通道，因为您使用的是单通道ADC。 由于其编码规范和数据包格式，这是传输数据的最有效模式。

    它将为您提供大约1.3Gsps * 12位分辨率* 66/64编码 /4通道= 4.02 GHz数据速率。 尽管它是9位部分，但它的设置与ADC12QJ1300相同，ADC12QJ1300 有12位。

    JMODE13和JMODE11需要更高的数据速率(分别为4.06 和5.2 GHz)，因为它们的8B/10B编码规范不够充分，但在任何其他方面都不会更好

    谢谢！

    已绘制