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[参考译文] ADS7042:关于 CS 时序。

Guru**** 2381700 points
Other Parts Discussed in Thread: ADS7040, ADS7042
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/1105364/ads7042-about-the-cs-timing

器件型号:ADS7042
主题中讨论的其他器件:ADS7040

大家好、

我的客户正在考虑使用 ADS7040进行更换。
但它们需要通过8位时序控制 CS。
如果在 ADS7042的转换时间内 CS 设置为高电平、会发生什么情况?

此致。
Kengo。

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    您好 Kengo、

    如果 CS 上拉为高电平、则采集阶段将开始。 这将中断转换阶段、如果输入没有完全稳定、那么输出代码中可能会出现一些错误。 我强烈建议提供至少14SCLK、如 ADS7042的时序图所示。  

    客户是否有理由希望切换设备?

    此致、
    Aaron

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    您好、Aaron、

    感谢你的答复。

    这是因为配送问题。
    我的客户正在考虑更换它、但无法进行软件更改、因此我正在发布。
    请问您遇到了什么问题?

    此致。
    Kengo。

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    您好 Kengo、

    由于 ADS7042是12位器件、因此需要发送~13SCLK 周期来覆盖转换时间。 如果发送的 CS 帧长度与 ADS7040配合使用、则该时间会缩短、可能会遇到一些意外行为。 最好遵循数据表中的时序图以确保正常运行。  

    此致、
    Aaron Estrada

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    您好 Kengo、

    仔细研究后、您实际上可以在转换阶段将 CS 置于高电平。  输出数据将被截断、最后4位将丢失。 请注意、您仍应遵守时序规格。  

    另请注意、LSB 大小仍将遵循12位器件的大小。  

    此致、
    Aaron Estrada