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[参考译文] ADS8166采样问题

Guru**** 2382480 points
Other Parts Discussed in Thread: ADS8166, ADS8168EVM-PDK
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/1128864/ads8166-sampling-problem

主题中讨论的其他器件:ADS8166ADS8168EVM-PDK

大家好、团队、

    我使用 ADS8166转换8个通道(从 AIN0到 AIN7自动序列模式),我发现在 某些电压(2.048V)上是否只添加了 AIN0 ,转换后,我们可以看到 AIN0为32768,AIN1也有一些值,接近100, 但 AIN2接近0。

   此外,我还进行了另一项测试; 只是在 某个电压(2.048V)上添加了 AIN1, 我们可以发现 AIN2有一些值,AIN3 接近0。

   等等

   因此,我想连续2次转换,第2次转换 将受到第1次转换的影响?  

   那么,如果你有一些关于它的经验吗?  

   请给我一些建议、 非常感谢!

BR

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    您好!

    我几乎肯定这是一个稳定时间问题。  从2.048V 的通道切换到0V 的下一通道时、输入采样电容器不会完全稳定。  如果是这种情况、您可以将采样率降低到50%、以证明这是根本原因。  您可能需要调整输入滤波器值、也可能需要使用速度更高的输入放大器来消除此问题。

    如果您可以分享包括 ADS8166和输入 RC 值以及任何输入放大器在内的原理图屏幕截图、我可以提供一些有关如何提高性能的更好建议。

    系统所需的采样率是多少?

    2.可接受的误差是什么?  100个代码可能太高了;10个代码是否可以接受、或者比本底噪声小一些?

    您还可以参阅《ADS8168EVM-PDK 用户指南》(ADS8166的高速版本)、了解支持高达1MSPS 数据速率的示例电路。

    https://www.ti.com/lit/ug/sbau291/sbau291.pdf

    此致、
    Keith Nicholas
    精密 ADC 应用

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    谢谢!

    输入滤波器为 R = 470R、C = 100nF

    如何将采样率降低到50%、在 ADS8166 中、250kSPS 是固定的?  或通过特定寄存器进行设置?

    2. 可接受的误差接近10。

    在我们的系统中、我们每1微秒对14个通道进行三次采样、 4us 是周期时间。

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    您好!

    感谢您提供更多信息。

     如何将采样率降低到50%、在 ADS8166 中、250kSPS 是固定的?  或通过特定寄存器进行设置?

    采样率由芯片选择(/CS)引脚的频率控制。  为了以250kSPS 的最大速率进行采样、/CS 引脚的频率将为250kHz。  作为测试、将/CS 引脚的频率降低50%。  这 应该会减少误差。

    /CS 信号的频率是多少?

    2. 可接受的误差接近10。  根据您的 R、C 值和误差小于10个计数、您可以采样总速率高达8ksps、或在1.75毫秒内扫描14个通道。  将 C 从100nF 更改为10nF、您可以采样高达40kSPS、误差计数少于10次、或者采样高达28ksps、趋稳误差计数少于1次、以实现完整的16b 性能。

    在 我们的系统中、我们每1微秒对14个通道进行三次采样、 4us 是周期时间。  我不理解这一说法。  ADS8166至少需要56us (微秒)才能扫描14个通道。  

    您是否在1毫秒(0.001秒)内扫描14个通道?  这相当于14ksps 的采样率(/CS 频率)。

    根据您的输入 R、C 滤波器值、这是一个稳定时间问题。  您可以通过降低/CS 频率(ADC 采样率)或降低输入滤波器值来减少误差。  如果采样率(/CS 频率)为14ksps、将 C 值降低到10nF 应消除由于稳定时间引起的所有串扰误差。

    此致、
    Keith

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    感谢您的善意回复!

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    不用客气!