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[参考译文] ADC12DJ3200:链路警报

Guru**** 2387060 points
Other Parts Discussed in Thread: ADC12DJ3200, LMK04828, ADC12DJ3200EVM
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/1052072/adc12dj3200-link-alarm

器件型号:ADC12DJ3200
主题中讨论的其他器件: LMK04828

您好!

我按如下方式配置了 ADC12DJ3200:

0x0000 0xB0 //进行软复位

延迟100ms
0x0200 0x00 //清除 JESD_EN (始终在 CAL_EN 之前)
0x0061 0x00 //清除 CAL_EN (始终位于 JESD_EN 之后)
0x0201 0x00 //设置 JMODE0
0x0202 0x03 //设置 KM1=3、因此 K=4
0x0204 0x05 //使用 TMSTP+/-输入、偏移二进制数据、启用扰频器

0x0205 0x04 //斜坡测试模式

0x003B 0x03 //启用 TSTP 接收器和 TSTP LVPECL
0x0213 0x07 //启用超范围,将超范围保持设置为最大周期8*2^7=1024个样本
0x0048 0x03 //将串行器预加重设置为3

0x029 0x30 //启用 SYSREF 接收器电路设置缩放位

读取0x02C-0x2E

0x029 0x74 //设置 SYSREF_PROC_EN SYSREF_SEL
0x0061 0x01 //设置 CAL_EN (始终在 JESD_EN 之前)
0x0200 0x01 //设置 JESD_EN (始终在 CAL_EN 之后)
0x006C 0x00 //将 CAL_SOFT_TRIG 设置为低电平以复位校准状态机
0x006C 0x01 //将 CAL_SOFT_TRIG 设置为高电平以启用校准

在参考设计中将 MASTER_RESET_n 信号设置为‘1’并将 Rx_SYNC_RESET_VIO 信号设置为‘0’后,寄存器0x0208和0x02C1中的值如下:

0x0208 = 0x0C

0x02C1 = 0x08

因此、似乎没有建立 JESD204链路

你对我有什么建议吗?

BR

Chris

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    尊敬的 Chris:

    您使用的是 ADC12DJ3200EVM 还是您自己的电路板? 如果您使用的是 ADC12DJ3200EVM、则必须启用从 LMK04828到 ADC 的 sysref 输出。 您可以通过转至 LMK04828->Clock Outputs 选项卡选择 LVPECL 而不是断电来启用 ADC 的 SYSREF。  

    我注意到的第二件事是、您没有在寄存器地址0x29中启用 sysref 处理。 如果不启用 SYSREF 处理、ADC 将不会查看 SYSREF 信号。  

    [引用 userid="502841" URL"~/support/data-converters-group/data-converters/f/data-converters-forum/1052072/adc12dj3200-link-alarm ]0x029 0x30 //启用 SYSREF 接收器电路设置缩放位[/quot]

    请使用以下内容更新此行:

    0x29 0x70 //启用 SYSREF 接收器、SYSREF 处理和 SYSREF 缩放。

    此致、

    Neeraj

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    Neeraj、您好!

    当然、我启用了 sysref 处理。 我在读取寄存器0x02c - 0x02E 后执行该操作、以使用寄存器0x029中的读取值。

    0x029 0x30 //启用 SYSREF 接收器电路设置缩放位

    读取0x02C-0x2E

    0x029 0x74 //设置 SYSREF_PROC_EN SYSREF_SEL

    不、我使用自己的板、但应用了 sysref。 我用示波器检查了它

    BR

    Chris

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    尊敬的 Chris:

    您是否在同一电路板上安装了 ADC 和 FPGA? 或者您是否正在使用 Xilinx 开发套件? 是否可以在不使用 ADC 上的 SYSREF 的情况下尝试使链路正常工作?

    此致、

    Neeraj

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    Neeraj、您好!

    没有 ADC 和 FPGA 位于同一电路板上、但所有 PLL 都与 ADC 位于同一电路板上。 是否可以在没有 sysref 的情况下运行 TI 参考 FPGA 设计?

    BR Chris

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    尊敬的 Chris:

    可以在没有 SYSREF 的情况下运行参考设计。 请在不使用 SYSREF 的情况下运行该设计、并在 ADC 端禁用 sysref 接收器和处理 、然后查看情况是否更好。  

    此致、

    Neeraj  

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    非常感谢您的支持。 主要问题是我使用的是 DA0-DA7而不是 DA0-DA3和 DB0-DB3。 现在、我可以使用 ADC 对信号进行采样。