大家好、团队、
我们的客户 正在考虑使用 DAC8411 @ VDD = 4V 和3.3V SPI。
在这种情况下、串行时钟频率是多少、20MHz 还是50MHz?
我认为数据表上的频率为50MHz、是这样吗?
此致、
Masakazu
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您好!
在 VDD = 4时、该器件将支持50MHz 的时钟频率、但仍必须满足 VIH 和 VIL 的时序要求。 时序要求 从(VIL + VIH)/2的电压电平开始计时、其中 VIH = 0.7VDD 且 VIL = 0.3VDD。
例如、SCLK 高电平时间 是在 SCLK 上升到2V 以上时测量的。 因此、请确保保持10ns。 确保 SCLK 保持在2V 以下10ns 以满足 SCLK 低电平时间要求。 这可能需要稍 慢的 SCLK 或非50%占空比。
最棒的
Katlynne Jones