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[参考译文] ADS1292:菊花链 ADS1292

Guru**** 2524680 points
Other Parts Discussed in Thread: ADS1292, ADS1299

请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/1018137/ads1292-daisy-chain-ads1292

器件型号:ADS1292
主题中讨论的其他器件: ADS1299

您好!

我想以菊花链方式连接3个 ADS1292。

1) 1)时钟频率或 SPS 是否有任何限制? 您给出了 ADS1299的答案(请参阅 ADS1299数据表的以下屏幕截图)、但对 ADS1292没有任何意见。

2) 2)数据输出是什么样的? 例如:STAT1-CH1-CH2-STAT2-CH3-CH4-STAT3-CH3-CH5-CH6、其中 STATN 对应于器件 n?

此外、我如何知道从器件之间的通道顺序? 我假设首先发送 ADS1292主器件 STAT 和通道(并且所有器件的 CH1都在 CH2之前)、但主器件如何区分发送数据的第二个或第三个从器件? 换句话说、上面的示例是: STAT1-CH1-CH2-STAT2-CH3-CH4-STAT3-CH5-CH6还是 STAT1-CH1-CH2-STAT2-CH5-CH6-STAT3-CH3-CH3-CH3-CH4?

3) 3)关于 RLD、我想使用两个单独的 RLD: 一个在主器件上、一个在从器件上。 我想这样做、因为 ADS1292主设备及其电极不会放在一只耳朵中、而两只 ADS1292从设备及其电极则放在另一只耳朵中。 因此、我不需要为所有这些引路都使用通用的 RLD。 我需要一个用于 ADS1292从器件的 RLD 和一个用于 ADS1292主器件的 RLD。 我看不出这是怎么会有问题的、但我更愿意要求大家做得更好。

此致

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    您好、Alexis、

    感谢您发帖。 请参阅下面我的评论。   

    1和2) ADS1292仅支持多器件配置模式(ADS1292数据表的图34)、不支持菊花链配置模式(ADS1299数据表的图70B)。 请注意、ADS1292没有 DAISY_IN 之类的引脚来促进菊花链运行。

    3) 3) RLD 的主要功能是改善 ECG/EEG 系统的 CMR (共模抑制)。 它还用于偏置患者以为所有输入建立共模电压。 我们建议对多个器件使用 RLD 连接、如数据表中的图41所示。

    谢谢

    -TC

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    您好、TCT、

    我知道所有这些(好吧、我没有使用正确的术语、它是多器件配置模式)。

    您能更具体地回答我的问题吗? 或者我应该通过测试来确定这一点吗?  

    谢谢

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    您好、Alexis、

    很抱歉、如果我误解了您的问题。 请告诉我以下评论是否有助于回答您的问题?

    1) 1)您是指器件时钟频率和 SPS 还是 SPI SCLK 频率? ADS1299的公式显式用于菊花链实现。 但是、如果您使用多个器件、则可以将其用作 ADS1292的估算值。 ADS1292的多器件配置略有不同、因为您需要使用 CSB 分别从每个器件检索数据。 数据表的表6.6中列出了 CSB 和 SCLK 信号的一些附加时序要求。

    2) 2)您能否详细说明、因为我对您的解释不清楚? 对于标准多器件配置、您需要使用主机处理器的 CSB 信号分别从器件检索数据。 器件数据输出格式将始终为 STAT-CH1-CH2。

    谢谢

    -TC

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    尊敬的 TC:

    1) 1)第一点清晰

    2) 2)如数据表中的图34所示、我已将所有 DRDY 引脚悬空、但连接到微处理器的 DRDY 引脚除外。 这意味着所有 ADS1292的数据输出将仅在一个 DRDY 引脚上提供。 数据表中还写入 DRDY 与 CS 无关(请参阅数据表中的第8.5.1.6节)。 因此、这与您的平均值不符、即:将 CS1置于低电平以获得 STAT1-CH1-CH2、然后将 CS2置于低电平以获得 STAT2-CH3-CH4等、对吧?

    3) 3)我想对左耳上的两个 ADS1292使用 RLD 驱动器、而对右耳上的 ADS1292使用另一个 RLD 驱动器。 这是因为它们不受相同的共模影响(因为右耳上有蓝牙天线)、并且它们距离很远。

    谢谢

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    您好、Alexis、

    请参阅下面我对问题2和3的评论。

    2) 2) DRDY 与 CSB 信号无关是正确的。 器件的 DRDY 将转换为低电平 、以指示 数据已准备好检索。 对于数据表的图34、您只需向主机微处理器使用一个 DRDYB 信号、因为所有的 ASD1292器件都通过 START 引脚进行同步。 当器件同步时、一个 DRDY 足以指示 SPI 总线上所有 ADS1292器件的数据已准备好检索。 由主机处理器发出特定的 CSB 来访问数据。

    3) 3)我认为应该可以、因为电极都是特定 RLD 驱动器的局部电极、正如您提到的。  

    谢谢

    -TC

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    尊敬的 TC:

    3)现在也很清楚、谢谢。

    2)因此给出了以下1个器件的 RDATAC SPI 图

    我会有三条 CSB 线路。 我按顺序读取器件1、2和3的输出数据。

    我想将 CSB1线路下拉(同时将 CSB2和 CSB3设置为高电平)以获得 STAT1-CH1-CH2、然后将 CSB1设置为高电平、将 CSB2设置为低电平以获得 STAT2-CH3-CH4等...

    但 DRDY 会如何工作? 当 CSB1为低电平时、它是在 SCLK 的第一个下降边沿上上升(情况1和2)、还是在 CSB3为低电平时等待 SCLK 的第一个下降边沿(情况3)。 如果它在 SCLK 的第一个下降沿上升、无论我还有其他器件的输出数据要检索、那么它在获取当前器件的输出数据时是否会再次变为低电平(如果没有案例1、如果是案例2)?

    我要问这一点、以了解如何触发 CSB 线路: 在计时器计数获取一个器件数据输出的时间(情况1和3)时、还是每次从 DRDY 获取中断时、我都会将必须关闭的 CSB 线路更改为(使用计数器从1更改为3)?

    也许图表会有助于澄清问题。

    谢谢

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    您好、Alexis、

    请注意、DRDY 和所有 SPI 信号的行为与您所示的 RDATAC 图完全相同。  当 CSB 为高电平时、串行接口被复位、因此该特定器件没有 SPI 通信。 这就是您可以在多器件配置中共享 SPI 总线(SCLK、DIN、DOUT)的原因。 请参阅下面的顶级示例、了解如何捕获三个器件的数据。

    DRDY (器件#1)将触发主机处理器的数据检索中断 IRQ 功能。 IRQ 功能将启动下面的数据检索序列。 在这种情况下、序列并不重要、因为所有器件的数据都已准备好在同步系统中进行检索。

    1. 将 CSB1设置为低电平、发送 SCLK 以从器件#1中检索数据、将 CSB1设置为高电平。 DRDY (器件#1)将在此序列中的第一个 SCLK 下降沿上变为高电平。
    2. 将 CSB2设置为低电平、发送 SCLK 以从器件#2中检索数据、将 CSB2设置为高电平。
    3. 将 CSB3设置为低电平、发送 SCLK 以从器件#3中检索数据、将 CSB3设置为高电平。

    在下一个 IRQ 用于连续中断进程之前、需要完成上述所有3个数据检索步骤。

    谢谢

    -TC

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    尊敬的 TC:

    感谢您的清晰解释

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    您好、Alexis、

    如果您需要进一步的帮助、请告知我们。  

    谢谢

    -TC