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[参考译文] ADS9224R：1.8V 时 DVDD 的时序图

admin
Guru**** 2378650 points
请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/1135315/ads9224r-timing-diagrams-for-dvdd-at-1-8v

器件型号：ADS9224R

您好！

DVDD 可支持数据表上的1.65V~5.5V。 但所有时序要求都是通过 DVDD@2.35V~5.5V 指定的。 当 DVDD<2.35V 时，我看不到任何时序要求。 TI 是否具有与1.65V~2.35V 不同的数字？

-Jason

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    TI__Guru**** 2378650 points
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    您好 Jason、

    让我与设计/系统团队核实这些时序规格中是否有任何受 DVDD < 2.35V 影响。目前、我只能看到、当 DVDD < 2.35V 时、SCLK 必须限制在20MHz 或更低

    此致、

    Ryan

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    TI__Guru**** 2378650 points
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    TI__Guru**** 2378650 points
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    您好 Jason、

    它看起来主要的区别在于数字输入高电平和低电平。 当 DVDD < 2.3V 时、输入信号必须更接近 DVDD 或 DGND、才能分别识别为数字高电平或低电平。

    此致、

    Ryan