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[参考译文] ADS1278：注入单端信号

admin
Guru**** 2383160 points
Other Parts Discussed in Thread: ADS1278, OPA2387, ADS127L01
请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/1030225/ads1278-injecting-a-single-ended-signal

器件型号：ADS1278
主题中讨论的其他器件： OPA2387、 ADS127L01

您好！

下面是有关 ADC 芯片 ADS1278的三个问题。

如下图所示，我想看看我的方法是否可行。 我将差分信号转换为1V 的单模信号、并注入 ADC ADS1278。 信号不能变为负值、因为 OPAM OPA2387是单侧偏置的。 我想确认这种方法是否有效？

2. ADC 将与 Tiva TM4C129 SPI 端口连接，是否可以使用 SYN 引脚来保持 ADC 并在需要时释放以开始转换？ 如果不是，如何保持 ADC，然后开始转换？   

3、SPI 将以控制器提供的10MHz 时钟与 SCLK 引脚上的 ADC 进行通信、同时 ADC 通过 J9连接器连接到自由运行的27MHz 晶体。 ADC 将处于高分辨率模式。 它在高分辨率模式下是否会以这种方式工作？

谢谢  

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    TI__Guru**** 2383160 points
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    您好！

    您可以驱动 ADS1278单端输入。  在此模式下、应将 AINN 连接到2.5V 基准偏置。  在此模式下、AINP 可以从0V 摆动到5V、这将被解释为+/-2.5V 差分输入。

    ADS1278连续转换。  主机 MCU 应监控 DRDY 线路并在 DRDY 置为有效时检索数据。   您可以使用 SYNC 引脚来保持转换、但随后必须等待数字滤波器稳定、这将显著降低输出数据速率。

    为了获得最佳性能、主机 MCU SCLK 应与27MHz 主时钟相同的时钟、并且应为最佳性能的1/2、1/4等值。  您可以将自由运行的27MHz 振荡器用于主时钟和10MHz SCLK、但您将看到频谱中的杂散。

    此致、
    Keith Nicholas
    精密 ADC 应用

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    TI__Guru**** 2383160 points
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    您好！

    还有一些其他意见。

    您应该在放大器的输出和 ADC 的输入之间添加一个 RC 滤波器。  R = 50 Ω 和 C = 1nF 将是一个很好的起点、但可能需要调整这些值以获得最佳性能。  如果保持 AINN 接地、则将限制为0V 至2.5V 的输入范围。

    此外、查看您的原理图、我注意到您在原理图中将 AGND 和 DGND 分开。  对于该器件、两个接地端必须连接到同一接地层。  如果您有单独的接地平面、则 ADS1278上的所有接地连接都应连接到模拟接地平面。

    此致、
    Keith

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    TI__Guru**** 2383160 points
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    您好、Keith、

    感谢你的答复。 uController 将充当主 SPI、ADC 将充当从 SPI、这意味着 uController 将为 SPI 生成 SCLK、这意味着 uController 不能配置为充当主 SPI、而是接收时钟。

    这意味着、我必须实现一个从10MHz SCLK 生成20MHz 的网络、并将其馈送到 ADC CLK 以避免频谱中的杂散。 但是、我不确定如何使 SCLK 线路的时钟加倍、以产生两个 SCLK 时钟馈送到 CLK 线路。 请提供任何参考资料等

    谢谢

    此致、

    Sahil

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    TI__Guru**** 2383160 points
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    您好、Sahil、

    使用外部晶体振荡器为 ADS1278和 MCU 提供主时钟。  然后、MCU 可以将该时钟分频为 SPI SCLK 的13.5MHz。  如果27MHz 频率对于 MCU 时钟而言过高、则可以使用 D 触发器在外部对其进行分频、并直接为 MCU 提供13.5MHz 电源。

    ADS127L01EVM 展示了使用 ADS127L01和 TM4C1294 MCU 的类似方法。

    此致、
    Keith

  • 0
    TI__Guru**** 2383160 points
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    控制器以25MHz 主时钟输入运行、该输入连接到内部 PLL 以生成120MHz 处理器时钟。

    采用与图片中第一种方法类似的方法、方法是将相同的25MHz 时钟馈送到 ADC 并以12.5MHz ( 主时钟的一半)运行 SPI ADC 是否会在 ADC 的高分辨率模式下工作、并避免 ADC 频谱中的杂散、因为 ADC 建议将27MHz 专门用于高分辨率模式？

    参考您之前有关 AGND 和 DGND 的评论、两者均通过0r 电阻器接地。

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    TI__Guru**** 2383160 points
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    您好、Sahil、

    是的、您也可以使用25MHz 主时钟在高分辨率模式下为 ADS1278计时。  唯一的区别是输出数据速率。  在高分辨率模式下、您现在将获得：

    Fdata = Fclk/512 = 25M/512 = 48828sps。

    以12.5MHz 运行 SCLK 将满足 SCLK/FCLK = 1、1/2、1/4、1/8、...的要求 以避免 ADC 频谱中的杂散。

    最好将 ADS1278的 AGND 和 DGND 引脚直接连接到电路板的 AGND 平面。  如果您通过 IC 封装旁边的0r 电阻进行连接、则器件将正常工作、但可能更容易受到 ESD 和过压瞬变的影响。

    以下是之前的 e2e 帖子、其中对此进行了更详细的讨论：

    ADS1278接地连接

    此致、
    Keith

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    TI__Guru**** 2383160 points
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    您好、Keith、

    非常感谢你的帮助。 你周末愉快！